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探索 3.3 - 5V 雙向電平轉(zhuǎn)換:簡(jiǎn)單實(shí)用電路剖析

出處:網(wǎng)絡(luò)整理 發(fā)布于:2025-07-30 15:39:10 | 669 次閱讀

電子電路設(shè)計(jì)中,當(dāng)使用 3.3V 的單片機(jī)時(shí),電平轉(zhuǎn)換是一個(gè)常見且關(guān)鍵的問題,經(jīng)常會(huì)遇到 3.3V 轉(zhuǎn) 5V 或者 5V 轉(zhuǎn) 3.3V 的情況。本文將介紹一種簡(jiǎn)單的電路,它能夠?qū)崿F(xiàn) 3.3V 和 5V 兩個(gè)電平的相互轉(zhuǎn)換,需要注意的是,這是雙向的轉(zhuǎn)換,而非單向轉(zhuǎn)換。該電路十分簡(jiǎn)單,僅由 3 個(gè)電阻和一個(gè) MOS 管構(gòu)成。

圖 1:雙向電平轉(zhuǎn)換電路示意

電路結(jié)構(gòu)與條件限制


電路圖如下所示:

圖 2:3.3 - 5V 雙向電平轉(zhuǎn)換電路圖
在圖中,S1 和 S2 為兩個(gè)信號(hào)端,VCC_S1 和 VCC_S2 為這兩個(gè)信號(hào)的高電平電壓。該電路有以下限制條件:
  1. VCC_S1 <= VCC_S2。這是為了保證電路能夠正常實(shí)現(xiàn)電平轉(zhuǎn)換,確保信號(hào)從低電壓端向高電壓端或者從高電壓端向低電壓端的穩(wěn)定傳輸。
  2. S1 的低電平門限大于 0.7V 左右(視 NMOS 內(nèi)的二極管壓降而定)。這個(gè)條件是為了避免因低電平過低而導(dǎo)致 NMOS 管誤動(dòng)作,影響電路的正常工作。
  3. Vgs <= VCC_S1。Vgs 是 MOS 管的柵源電壓,此條件限制了 MOS 管的柵源電壓范圍,防止因過高的電壓損壞 MOS 管。
  4. Vds <= VCC_S2。Vds 是 MOS 管的漏源電壓,該條件保證了 MOS 管在正常工作時(shí),漏源電壓不會(huì)超過其所能承受的范圍,從而保證 MOS 管的安全和電路的穩(wěn)定性。

對(duì)于 3.3V 和 5V/12V 等電路的相互轉(zhuǎn)換,NMOS 管選擇 AP2306 即可。該電路的原理相對(duì)簡(jiǎn)單,大家可以自行分析。并且,此電路已經(jīng)在多處得到應(yīng)用,效果良好。

電平轉(zhuǎn)換器的操作狀態(tài)


在電平轉(zhuǎn)換器的操作中,需要考慮以下三種狀態(tài):
  1. 沒有器件下拉總線線路:“低電壓” 部分的總線線路通過上拉電阻 Rp 上拉至 3.3V。此時(shí),MOS - FET 管的門極和源極都是 3.3V,所以它的 VGS 低于閥值電壓,MOS - FET 管不導(dǎo)通。這就允許 “高電壓” 部分的總線線路通過它的上拉電阻 Rp 拉到 5V。此時(shí)兩部分的總線線路都是高電平,只是電壓電平不同。這種狀態(tài)下,電路實(shí)現(xiàn)了電平的隔離和不同電壓的保持。
  2. 一個(gè) 3.3V 器件下拉總線線路到低電平:MOS - FET 管的源極也變成低電平,而門極是 3.3V。VGS 上升高于閥值,MOS - FET 管開始導(dǎo)通。然后 “高電壓” 部分的總線線路通過導(dǎo)通的 MOS - FET 管被 3.3V 器件下拉到低電平。此時(shí),兩部分的總線線路都是低電平,而且電壓電平相同。這種狀態(tài)下,實(shí)現(xiàn)了 3.3V 信號(hào)對(duì) 5V 總線的控制,將低電壓信號(hào)傳遞到了高電壓端。
  3. 一個(gè) 5V 的器件下拉總線線路到低電平:MOS - FET 管的漏極基底二極管 “低電壓” 部分被下拉直到 VGS 超過閥值,MOS - FET 管開始導(dǎo)通。“低電壓” 部分的總線線路通過導(dǎo)通的 MOS - FET 管被 5V 的器件進(jìn)一步下拉到低電平。此時(shí),兩部分的總線線路都是低電平,而且電壓電平相同。這種狀態(tài)下,實(shí)現(xiàn)了 5V 信號(hào)對(duì) 3.3V 總線的控制,將高電壓信號(hào)傳遞到了低電壓端。

這三種狀態(tài)顯示了邏輯電平在總線系統(tǒng)的兩個(gè)方向上傳輸,與驅(qū)動(dòng)的部分無關(guān)。狀態(tài) 1 執(zhí)行了電平轉(zhuǎn)換功能,狀態(tài) 2 和 3 按照 I2C 總線規(guī)范的要求在兩部分的總線線路之間實(shí)現(xiàn) “線與” 的功能。
除了 3.3V VDD1 和 5V VDD2 的電源電壓外,還可以是例如:2V VDD1 和 10V VDD2。在正常操作中,VDD2 必須等于或高于 VDD1(在開關(guān)電源時(shí)允許 VDD2 低于 VDD1)。

MOS - N 場(chǎng)效應(yīng)管雙向電平轉(zhuǎn)換電路



圖 3:MOS - N 場(chǎng)效應(yīng)管雙向電平轉(zhuǎn)換電路
為了方便講述,定義 3.3V 為 A 端,5.0V 為 B 端。其雙向傳輸原理如下:
  • A 端輸出低電平時(shí)(0V):MOS 管導(dǎo)通,B 端輸出是低電平(0V)。這是因?yàn)?A 端的低電平使得 MOS 管的柵源電壓滿足導(dǎo)通條件,從而將 B 端拉低。
  • A 端輸出高電平時(shí)(3.3V):MOS 管截至,B 端輸出是高電平(5V)。此時(shí),由于 A 端的高電平使得 MOS 管不導(dǎo)通,B 端通過上拉電阻保持在高電平。
  • A 端輸出高阻時(shí)(OC):MOS 管截至,B 端輸出是高電平(5V)。高阻狀態(tài)相當(dāng)于 A 端沒有對(duì) MOS 管進(jìn)行驅(qū)動(dòng),MOS 管不導(dǎo)通,B 端保持高電平。
  • B 端輸出低電平時(shí)(0V):MOS 管內(nèi)的二極管導(dǎo)通,從而使 MOS 管導(dǎo)通,A 端輸出是低電平(0V)。B 端的低電平通過二極管使 MOS 管導(dǎo)通,進(jìn)而將 A 端拉低。
  • B 端輸出高電平時(shí)(5V):MOS 管截至,A 端輸出是高電平(3.3V)。B 端的高電平使得 MOS 管不導(dǎo)通,A 端通過上拉電阻保持在高電平。
  • B 端輸出高阻時(shí)(OC):MOS 管截至,A 端輸出是高電平(3.3V)。同樣,高阻狀態(tài)下 B 端不對(duì) MOS 管產(chǎn)生影響,MOS 管不導(dǎo)通,A 端保持高電平。

電路優(yōu)點(diǎn)


  1. 適用于低頻信號(hào)電平轉(zhuǎn)換,價(jià)格低廉:該電路在低頻信號(hào)的電平轉(zhuǎn)換中表現(xiàn)出色,而且由于其僅使用了幾個(gè)簡(jiǎn)單的電阻和一個(gè) MOS 管,成本較低,適合大規(guī)模應(yīng)用。
  2. 導(dǎo)通后,壓降比三極管?。合啾热龢O管,MOS 管在導(dǎo)通時(shí)的壓降更小,這意味著在信號(hào)傳輸過程中,能量損耗更小,能夠提高電路的效率。
  3. 正反向雙向?qū)?,相?dāng)于機(jī)械開關(guān):該電路能夠?qū)崿F(xiàn)正反向的雙向?qū)?,就像機(jī)械開關(guān)一樣,可以靈活地控制信號(hào)的傳輸方向,滿足不同的電路需求。
  4. 電壓型驅(qū)動(dòng),當(dāng)然也需要一定的驅(qū)動(dòng)電流,而且有的應(yīng)用也許比三極管大:雖然 MOS 管是電壓型驅(qū)動(dòng)器件,但在某些應(yīng)用中,其所需的驅(qū)動(dòng)電流可能比三極管大。不過,這并不影響其在很多場(chǎng)合的應(yīng)用,因?yàn)槠淦渌麅?yōu)點(diǎn)足以彌補(bǔ)這一小小的不足。
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