IDT72V36110L10PF
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QFP/25+
提供BOM一站式配單服務
,但保留可編程設置項; ●幾乎空/滿標志置位或無效操作可選擇同步或異步時間模式; ●具有兩種時間工作模式,分別為 idt標準模式(采用和標志位)和fwft首字直傳模式(采用標志位); ●讀寫操作采用獨立時鐘,并可異步操作; ●采用tqfp(128引腳)和pbga(144引腳)兩種封裝形式,其中pbga封裝形式不僅可用jtag口提供邊界掃描功能,還可選擇同步或者異步讀寫操作(只對pbga封裝); ●與5v輸入兼容; ●具有節(jié)電模式; ●管腳可與更高密度的芯片idt72v36100和idt72v36110兼容。 idt72v3680的內(nèi)部結(jié)構(gòu)框圖如圖1所示。 2.2使用要點 idt72v3680系列產(chǎn)品在使用中,通常應注意以下幾點: (1)兩種可選擇的時間運行模式的區(qū)別 在主復位時,fwft/si信號電平為低表示選擇idt標準模式,否則表示選擇首位字直傳模式fwft。在兩種不同模式下,其輸出的標志信號也有所不同,其中、為idt標準模式;(輸出準備好)輸入準備好)為fwft模式。另一個區(qū)別是在fwft方式下,第一個寫入字在三個讀時鐘上升沿后將直接傳到輸出qn上
補晶振提供,板上晶振輸出信號為140mhz的正弦波。由于內(nèi)、外時鐘都是單端輸入,因此需要進行t/e變換之后才能作為ad9430的采樣時鐘,而t/e變換則可以通過synergy公司的sy100el15l芯片來實現(xiàn)。數(shù)據(jù)緩存電路ad9430在cmos工作模式下,時鐘信號二分頻后由dco+和dco-兩端口輸出,該數(shù)據(jù)時鐘輸出信號可以直接作為數(shù)據(jù)鎖存時鐘,而且時鐘失真很低。由于ad9430數(shù)據(jù)轉(zhuǎn)換輸出的速度非??欤虼?,在各輸出端口還應另加鎖存電路,以確保fifo所接收數(shù)據(jù)的正確性。本設計中fifo選用idt72v36110,它是idt公司推出的低功耗、大容量的同步fifo,其存取時間為7.5ns,容量為128k×36bit,可以滿足ad9430輸出數(shù)據(jù)對存取時間的要求。最重要的是它能將并行存儲的采集數(shù)據(jù)按照采樣點的順序依次讀出。接口電路設計接口電路主要包括以下兩個部分:isa總線接口isa總線在本系統(tǒng)中的作用包括電源供給、i/o地址空間(0100h~03ffh)分配,以及發(fā)送系統(tǒng)自檢、復位等控制命令。fpdp總線接口應用vita標準中的fpdp總線,能夠滿足系統(tǒng)高速數(shù)據(jù)傳輸?shù)囊?。設計中fpdp總線上的數(shù)據(jù)信號和
se;end process changestatemode;4 應用和結(jié)論 目前該接口板已經(jīng)完成了電路設計、軟件仿真和制板,并應用到某機載合成孔徑雷達數(shù)字信號處理機中。接口板卡位于信號處理機的前端,通過cpci機箱的前面板接口,采用一塊pmc子板實現(xiàn)。系統(tǒng)采用了圖1所示的體系結(jié)構(gòu),鎖存器選用ti公司的sn74lvt16374, sn74lvt16374,時鐘驅(qū)動芯片選用idt公司的idt49fct3805apyidt49fct3805apy,fifo選用idt公司的idt72v36110idt72v36110,pci接口芯片選用plx9052plx9052,fpga選用altera公司的ep1k100fc256-1ep1k100fc256-1。經(jīng)過實驗室階段和外廠試驗,接口板都工作正常,達到了設計要求。 來源:零八我的愛
編程設置項; 幾乎空/滿標志置位或無效操作可選擇同步或異步時間模式; 具有兩種時間工作模式,分別為idt標準模式(采用和標志位)和fwft首字直傳模式(采用標志位); 讀寫操作采用獨立時鐘,并可異步操作; 采用tqfp(128引腳)和pbga(144引腳)兩種封裝形式,其中pbga封裝形式不僅可用jtag口提供邊界掃描功能,還可選擇同步或者異步讀寫操作(只對pbga封裝); 與5v輸入兼容; 具有節(jié)電模式; 管腳可與更高密度的芯片idt72v36100和idt72v36110兼容。 idt72v3680的內(nèi)部結(jié)構(gòu)框圖如圖1所示。 來源:春天的早晨