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IDT72V845 3.3 VOLT CMOS DUAL SyncFIFO DUAL 256... IDT IDT72V845PDF下載
IDT72V845 3.3 VOLT CMOS DUAL SyncFIFO DUAL 256... IDT [Integrated Device Technology] IDT72V845PDF下載
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IDT72V845L10PFG 暫無描述 IDT IDT72V845L10PFGPDF下載
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idt72v845中文資料

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基于FPGA的新型諧波分析儀設(shè)計(jì)
示。fft運(yùn)算處理單元基于一塊altera公司的ep1c20fpga芯片，該芯片帶有294912位ram，具有20060個(gè)le，最大i/o引腳301。fft運(yùn)算處理單元采用先進(jìn)的多層并行流水線技術(shù)，工作在30mhz的頻率下，可以在1ms內(nèi)完成8路工頻輸入信號的256點(diǎn)fft運(yùn)算處理。該處理單元的原理如圖3所示。該單元實(shí)際包含兩大部分，即采樣控制邏輯部分和fft運(yùn)算部分。采樣邏輯部分負(fù)責(zé)max125的讀數(shù)據(jù)邏輯控制。fft運(yùn)算部分包括fft控制邏輯、采樣數(shù)據(jù)緩存、fft處理核與結(jié)果存儲fifo。從idt72v845輸出的14位采樣數(shù)據(jù)，首先暫存于采樣數(shù)據(jù)緩存中；然后fft處理核從該緩存中讀取數(shù)據(jù)進(jìn)行處理；處理完畢的數(shù)據(jù)存放于結(jié)果fifo中；fft控制邏輯單元向nios處理器申請中斷，nios處理器響應(yīng)應(yīng)該中斷向fft控制邏輯單元發(fā)送讀信號；然后從結(jié)果fifo讀取分析結(jié)果。以往fft設(shè)計(jì)中，往往使用定點(diǎn)數(shù)。因?yàn)槭褂枚c(diǎn)數(shù)時(shí)，系統(tǒng)結(jié)構(gòu)相對簡單、運(yùn)算速度快，但精度不高。在fpga中使用浮點(diǎn)數(shù)時(shí)，系統(tǒng)相對設(shè)計(jì)復(fù)雜，但精度高?；诒鞠到y(tǒng)對精度的苛刻要求，故采用浮點(diǎn)數(shù)進(jìn)行fft的硬件算術(shù)實(shí)現(xiàn)。fft處理核采用先進(jìn)的多