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  • 基于CPLD的異步ASI/SDI信號(hào)電復(fù)接光傳輸設(shè)備的設(shè)計(jì)

    也是一個(gè)問題。信號(hào)路數(shù)越多，速率越高，越難鎖定，對(duì)pcb板的排版技術(shù)要求較高。通過對(duì)各個(gè)元器件的合理放置和科學(xué)的濾除雜波等各項(xiàng)處理，這個(gè)問題可以得到很好的解決。 硬件電路 在該設(shè)計(jì)中，主要使用的是美國國家半導(dǎo)體公司最新推出的功能強(qiáng)大且性能穩(wěn)定的數(shù)字視頻芯片組。其中解碼及串/并轉(zhuǎn)換芯片選用clc011；編碼及并/串轉(zhuǎn)換芯片選用clc020；時(shí)鐘恢復(fù)芯片選用lmh0046；自適應(yīng)電纜均衡芯片選用clc014；cpld芯片采用lattice公司的lc4256v；fifo芯片采用idt公司的idt72v2105。 均衡部分電路處理過程如圖2所示。由圖2可知單端輸入的asi/sdi串行信號(hào)通過均衡電路后得到整形，轉(zhuǎn)變成一組差分信號(hào)，為接下來的時(shí)鐘恢復(fù)過程作好了準(zhǔn)備。通過均衡電路以后，信號(hào)質(zhì)量大大提高，輸入輸出信號(hào)波形比較如圖3。 圖2 均衡部分電路處理過程 圖3 均衡電路波形比較 時(shí)鐘恢復(fù)部分電路處理過程由圖4所示。通過圖4可以看到，正確地設(shè)置好芯片的工作模式，由本地提供一個(gè)27m的時(shí)鐘供時(shí)鐘恢復(fù)芯片使用，將均衡后的高速差分信號(hào)輸入到芯片中，通過芯片處理后恢復(fù)出串

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