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基于PC機的模擬信號發(fā)生器的設(shè)計
塊內(nèi)部復(fù)位信號，mwdsl是電平敏感鎖存器使能信號，trst是一位鎖存器模塊復(fù)位信號，txdata是串行數(shù)據(jù)輸出信號。當(dāng)數(shù)據(jù)轉(zhuǎn)換器開始工作的時候，電平敏感鎖存器使能信號（mwdsl）有效，并行數(shù)據(jù)被送入鎖存器，之后，控制模塊產(chǎn)生并入串出移位寄存器裝入信號（stld），以在時鐘信號（tclk）的作用下，將并行數(shù)據(jù)裝入并入串出移位寄存器，然后，控制模塊再產(chǎn)生并入串出移位寄存器移位信號（stld），并在時鐘信號（tclk）的作用下，將并行數(shù)據(jù)移出。本設(shè)計中采用altera的cpld（flex epf10k20rc240）來實現(xiàn)數(shù)據(jù)轉(zhuǎn)換器的硬件電路功能，并用quartus ⅱ軟件進(jìn)行源文件設(shè)計。在電路頂層，我們采用原理圖和結(jié)構(gòu)圖的形式進(jìn)行數(shù)據(jù)轉(zhuǎn)換器的整體框架設(shè)計。quartus ⅱ為實現(xiàn)不同的邏輯功能提供了大量的基本單元符號和宏功能模塊，這些符號與模塊的管腳定義與功能一般都是默認(rèn)的，而在結(jié)構(gòu)圖輸入方式中，我們可以根據(jù)自行定義模塊的管腳與功能。結(jié)構(gòu)圖定義的模塊上只是一些自行定義的方框和管腳符號, 沒有涉及其內(nèi)部具體邏輯, 因而這種模塊稱之為頂層模塊。頂層模塊的內(nèi)部具體邏輯可以通過硬件描述語言來編寫，也可以
一種FIR數(shù)字濾波器設(shè)計與仿真
響應(yīng)（包括對沖擊的響應(yīng)）也是有限的。若線性系統(tǒng)僅是一個空間濾波器，則通過簡單地觀察它對沖擊的響應(yīng)，我們就可以完全確定該濾波器。通過這種方式確定的濾波器稱為有限沖擊響應(yīng)（fir）濾波器。fir濾波器是在數(shù)字信號處理（dsp）中經(jīng)常使用的兩種基本的濾波器之一，另一個為iir濾波器。iir濾波器是無限沖激響應(yīng)濾波器。圖6給出fir數(shù)字濾波電路。該電路包括高密度可編程邏輯器件、有源品體振蕩器、10針插座以及多只電阻和按鍵開關(guān)。這里選用的高密度可編程邏輯器件為aixera公司flexlok系列的epf10k20rc240—3。配置的濾波器設(shè)計后，利用器件中的剩余資源，即由epfl0k20rc240—4型fpga控制a／d轉(zhuǎn)換器和d／a轉(zhuǎn)換器的功能。其中，引腳rd、adcs分別與a／d轉(zhuǎn)換器的引腳rd、cs相連，而引腳wr、ldac、dacs分別與d／a轉(zhuǎn)換電路的引腳wr、ldac、cs相連。 5 濾波效果測試將設(shè)計的低通濾波器的配置文件下載到器件中進(jìn)行實際濾波測試，用示波器觀察各個頻率點上輸出信號的幅值大小。由濾波測試結(jié)果可知，該fir濾波電路完全達(dá)到低通濾波器5 mhz的采樣頻率，1

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