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原裝IDT系列量多從優(yōu)新亞洲4B025
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市場價原廠原裝假一罰十
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用于制造業(yè)自動化控制各個領(lǐng)域。 1 硬件電路總體設(shè)計 為實現(xiàn)對多電機的半閉環(huán)控制提供了一個良好的開發(fā)平臺。本項目是設(shè)計一款基于pci總線的，以dsp芯片tms320f2812為核心的多軸運動控制卡。將pc機的信息處理能力和開放式的特點與運動控制器的運動軌跡控制能力有機地結(jié)合在一起，利用雙口ram作為公共存儲單元實現(xiàn)上／下位機的通信。 系統(tǒng)硬件總體設(shè)計功能框圖如圖1所示。 2 雙口ram接口電路設(shè)計 2．1 雙口ram與dsp和ch365的連接 本系統(tǒng)選用雙口ram芯片idt7025作為dsp與ch365雙向通信的緩沖芯片。idt7025芯片是一款高速的8k×16位雙口靜態(tài)ram，它提供2個獨立的端口，允許兩個(左、右)端口同時讀／寫數(shù)據(jù)，每個端口具有自己獨立的控制信號線、地址線和數(shù)據(jù)線，可高速存取數(shù)據(jù)，可與大多數(shù)高速處理器配合使用，而無需插入等待狀態(tài)。 雙口ram允許2個cpu同時讀取任何存儲單元（包括同時讀同一地址單元），但不允許同時寫或一讀一寫同一地址單元。本系統(tǒng)采用基于郵箱機制的int中斷法處理雙口ramd地址競爭沖突現(xiàn)象，避免由此而產(chǎn)生的讀／寫錯誤。 下面
c104總線訪問sram時，數(shù)據(jù)吞吐率約為2.5mb/s，滿足系統(tǒng)要求。所以系統(tǒng)設(shè)計時采用了基于pc104總線的數(shù)據(jù)傳輸方式。信號處理機和工控機通過pc104總線的數(shù)據(jù)傳輸方法有多種。例如，可以采用dma方法，但是同時只能有一個系統(tǒng)訪問存儲器；還可利用并口鎖存方法傳輸數(shù)據(jù)。但是這兩種方法都不能獲得高數(shù)據(jù)吞吐率。為了解決這個問題，可采用雙口sram實現(xiàn)adsp-21062向工控機進行高速數(shù)據(jù)傳輸。系統(tǒng)設(shè)計時采用的雙口sram可以是16bit或8bit。在本系統(tǒng)采用了8k×16bit的雙口sram—idt7025。系統(tǒng)以16bit的數(shù)據(jù)進行傳輸，相比8bit的方式而言，有更高的數(shù)據(jù)吞吐率。 雙口sram的工作原理雙口sram的存儲器陣列，有左右兩套地址和數(shù)據(jù)總線。這樣，位于兩個端口的左右系統(tǒng)可以共享一個存儲單元。當兩個端口對雙口sram進行讀寫時，存在下列可能情況：a：不同時對相同地址單元讀/寫操作；b：同時對相同地址單元讀數(shù)據(jù)；c：同時對相同地址單元寫入數(shù)據(jù)。idt7025內(nèi)部有8個獨立于雙端口存儲單元的鎖存邏輯單元，作為令牌使用，可將空間劃分成1~8個區(qū)段。使用這些單元產(chǎn)生一個使用標志，向另一個端
（如數(shù)據(jù)抽取、積分等）。整個電路系統(tǒng)采用模塊化設(shè)計，便于調(diào)試及擴展。信號處理模塊原理框圖如圖2所示。 在圖2中，tmc2310和tms320c25之間設(shè)計了一個以乒乓方式工作的雙口ram陣列，其作用有四：(1)存放待處理的數(shù)據(jù)(實部數(shù)據(jù)放在rem塊，虛部數(shù)據(jù)放在imm塊)；(2)存放tmc2310所需的系數(shù)或參數(shù)（放在wdm塊）；(3)存放tmc2310的輸出結(jié)果并作為tmc2310中間結(jié)果緩存；(4)構(gòu)成tms320c25的運算內(nèi)存。為了便于構(gòu)成系統(tǒng)及滿足實時需要，用一片idt7025雙口ram（8k×16）構(gòu)成一個tms320c25與外部共享的ｒａｍ區(qū)，以便實時地與外部進行數(shù)據(jù)交換和通訊。這個雙口ｒａｍ區(qū)也以乒乓方式工作，以增強模塊的寬容性。電路的乒乓工作方式控制邏輯是由tms320c25根據(jù)系統(tǒng)的節(jié)拍時序進行控制的。控制電路確保caa12與cab12互斥，cal12與car12互斥。整個電路簡單、緊湊、協(xié)調(diào)有序。由于采用了vlsi器件設(shè)計，電路設(shè)計大大簡化，調(diào)試方便、功能強大、性能可靠、吞吐量大（完成1024點fft的數(shù)據(jù)通過率為2.343m字／秒）。 3 軟件設(shè)計
續(xù)處理及輔助運算（如數(shù)據(jù)抽取、積分等）。整個電路系統(tǒng)采用模塊化設(shè)計，便于調(diào)試及擴展。信號處理模塊原理框圖如圖2所示。 在圖2中，tmc2310和tms320c25之間設(shè)計了一個以乒乓方式工作的雙口ram陣列，其作用有四：（1）存放待處理的數(shù)據(jù)（實部數(shù)據(jù)放在rem塊，虛部數(shù)據(jù)放在imm塊）；（2）存放tmc2310所需的系數(shù)或參數(shù)（放在wdm塊）；（3）存放tmc2310的輸出結(jié)果并作為tmc2310中間結(jié)果緩存；（4）構(gòu)成tms320c25的運算內(nèi)存。為了便于構(gòu)成系統(tǒng)及滿足實時需要，用一片idt7025雙口ram（8k×16）構(gòu)成一個tms320c25與外部共享的ram區(qū)，以便實時地與外部進行數(shù)據(jù)交換和通訊。這個雙口ram區(qū)也以乒乓方式工作，以增強模塊的寬容性。 電路的乒乓工作方式控制邏輯是由tms320c25根據(jù)系統(tǒng)的節(jié)拍時序進行控制的?？刂齐娐反_保caa12與cab12互斥，cal12與car12互斥。整個電路簡單、緊湊、協(xié)調(diào)有序。由于采用了vlsi器件設(shè)計，電路設(shè)計大大簡化，調(diào)試方便、功能強大、性能可靠、吞吐量大（完成1024點fft的數(shù)據(jù)通過率為2.343m字/秒）。 3 軟件
其主要接口電路如圖2所示。 由dsp接口電路圖可以看出，dsp模塊為整個系統(tǒng)提供了時鐘電路，dsp芯片的中斷由ep20k200產(chǎn)生，一方面通知f206讀取數(shù)據(jù)，一方面通知dsp進行錯誤處理，由于dsp芯片的流水線操作方式，數(shù)字信號處理速度功能強大，滿足了1553b協(xié)議傳輸速率大的特點。 3.4 雙口ram和顯示模塊 由于在高速數(shù)據(jù)處理和采集系統(tǒng)中容易造成數(shù)據(jù)堵塞現(xiàn)象，高速數(shù)據(jù)接口的設(shè)計對整個系統(tǒng)數(shù)據(jù)傳輸?shù)臅惩ㄆ鹬匾淖饔?，該設(shè)計中采用的美國ddc公司的8k雙口靜態(tài)ram idt7025解決了數(shù)據(jù)堵塞的問題。 在該設(shè)計中顯示模塊采用了一種內(nèi)存接顯示模塊的硬件連接方式。dsp將欲顯示的數(shù)據(jù)送入雙口ram，51單片機不斷掃描內(nèi)存，根據(jù)內(nèi)存中的數(shù)據(jù)做出相應(yīng)的處理，不斷刷新顯示屏上的內(nèi)容，雙口ram的busy信號線為避免左右端口同時對同一存儲單元寫操作提供了硬件支持。設(shè)計中液晶顯示模塊采用16×16點陣的中文顯示模塊。 4 系統(tǒng)軟件設(shè)計 該1553b航空電子總線檢測儀軟件設(shè)計主要包括3大部分，用以驅(qū)動數(shù)據(jù)采集板卡，完成對各寄存器的配置，實現(xiàn)數(shù)據(jù)的收發(fā)檢測。 4.
口電路如圖2所示。 由dsp接口電路圖可以看出，dsp模塊為整個系統(tǒng)提供了時鐘電路，dsp芯片的中斷由ep20k200產(chǎn)生，一方面通知f206讀取數(shù)據(jù)，一方面通知dsp進行錯誤處理，由于dsp芯片的流水線操作方式，數(shù)字信號處理速度功能強大，滿足了1553b協(xié)議傳輸速率大的特點。 3.4 雙口ram和顯示模塊 由于在高速數(shù)據(jù)處理和采集系統(tǒng)中容易造成數(shù)據(jù)堵塞現(xiàn)象，高速數(shù)據(jù)接口的設(shè)計對整個系統(tǒng)數(shù)據(jù)傳輸?shù)臅惩ㄆ鹬匾淖饔茫撛O(shè)計中采用的美國ddc公司的8k雙口靜態(tài)ram idt7025解決了數(shù)據(jù)堵塞的問題。 在該設(shè)計中顯示模塊采用了一種內(nèi)存接顯示模塊的硬件連接方式。dsp將欲顯示的數(shù)據(jù)送入雙口ram，51單片機不斷掃描內(nèi)存，根據(jù)內(nèi)存中的數(shù)據(jù)做出相應(yīng)的處理，不斷刷新顯示屏上的內(nèi)容，雙口ram的busy信號線為避免左右端口同時對同一存儲單元寫操作提供了硬件支持。設(shè)計中液晶顯示模塊采用16×16點陣的中文顯示模塊。 4 系統(tǒng)軟件設(shè)計 該1553b航空電子總線檢測儀軟件設(shè)計主要包括3大部分，用以驅(qū)動數(shù)據(jù)采集板卡，完成對各寄存器的配置，實現(xiàn)數(shù)據(jù)的收發(fā)檢測。
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