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器設計 c6711訪問外部存儲器必須通過emif。emif不僅有很高的數(shù)據(jù)吞吐率,而且還有很強的接口能力,可以與目前所有類型的存儲器直接接口,設計采用三種類型的存儲器:flash rom、雙口ram和同步動態(tài)存儲器sdram,flash rom是現(xiàn)場可擦除、掉電后可保持數(shù)據(jù)的存儲器,用來固化程序和保存掉電后需要保存的數(shù)據(jù),雙口ram用來存儲一幀圖象數(shù)據(jù);sdram運行速度快,用存放實時運行程序和臨時數(shù)據(jù),本系統(tǒng)flash rom采用sst39v040,且配置在ce1空間,雙口ram采用idt70v28,且配置在ce2空間,選用hy57v563220作為sdram,配置在ce0空間,這樣的配置與引導方式相配合。 1.6 輸出電路 系統(tǒng)根據(jù)輸入的圖像,由c6711進行處理后得出的一個衛(wèi)星姿態(tài)角信息,該姿態(tài)角信息由c6711輸出到pc機的rs-232口,由于通信的信息量少,所以可以利用c6711的多通道緩沖串口mcbsp,在不擴展其他硬件的情況下,用實現(xiàn)異步數(shù)據(jù)傳輸格式,發(fā)送時,發(fā)送轉換子程序把每一個數(shù)據(jù)位擴展成16位的uart字,并把這些已轉換好的數(shù)據(jù)塊放入發(fā)送緩沖區(qū),同時在
外部存儲器設計c6711訪問外部存儲器必須通過emif。emif不僅有很高的數(shù)據(jù)吞吐率,而且還有很強的接口能力,可以與目前所有類型的存儲器直接接口,設計采用三種類型的存儲器: flash rom、雙口ram和同步動態(tài)存儲器sdram,flash rom是現(xiàn)場可擦除、掉電后可保持數(shù)據(jù)的存儲器,用來固化程序和保存掉電后需要保存的數(shù)據(jù),雙口ram用來存儲一幀圖象數(shù)據(jù);sdram運行速度快,用存放實時運行程序和臨時數(shù)據(jù),本系統(tǒng)flash rom采用sst39v040,且配置在ce1空間,雙口ram采用idt70v28,且配置在ce2空間,選用hy57v563220作為sdram,配置在ce0空間,這樣的配置與引導方式相配合。1.6 輸出電路系統(tǒng)根據(jù)輸入的圖像,由c6711進行處理后得出的一個衛(wèi)星姿態(tài)角信息,該姿態(tài)角信息由c6711輸出到pc機的rs-232口,由于通信的信息量少,所以可以利用 c6711的多通道緩沖串口mcbsp,在不擴展其他硬件的情況下,用實現(xiàn)異步數(shù)據(jù)傳輸格式,發(fā)送時,發(fā)送轉換子程序把每一個數(shù)據(jù)位擴展成16位的 uart字,并把這些已轉換好的數(shù)據(jù)塊放入發(fā)送緩沖區(qū),同時在適當?shù)牡胤郊由掀鹗己?/p>
器設計 c6711訪問外部存儲器必須通過emif。emif不僅有很高的數(shù)據(jù)吞吐率,而且還有很強的接口能力,可以與目前所有類型的存儲器直接接口。設計采用三種類型的存儲器:flash rom、雙口ram和同步動態(tài)存儲器sdram。flash rom 是現(xiàn)場可擦除、掉電后可保持數(shù)據(jù)的存儲器,用來固化程序和保存掉電后需要保存的數(shù)據(jù);雙口ram用來存儲一幀圖像數(shù)據(jù);sdram運行速度快,用來存放實時運行程序和臨時數(shù)據(jù)。本系統(tǒng)flash rom采用sst39vf040,且配置在ce1空間。雙口ram采用idt70v28,且配置在ce2空間。選用hy57v653220作為sdram,配置在ce0空間,這樣的配置與引導方式相配合。 1.6 輸出電路 系統(tǒng)根據(jù)輸入的圖像,由c6711進行處理后得出一個衛(wèi)星姿態(tài)角信息。該姿態(tài)角信息由c6711輸出到pc機的rs-232口,由于通信的信息量少,所以可以利用c6711的多通道緩沖串口mcbsp,在不擴展其他硬件的情況下,用軟件實現(xiàn)異步數(shù)據(jù)傳輸格式。發(fā)送時,發(fā)送轉換子程序把每一個數(shù)據(jù)位擴展成16位的uart字,并把這些已轉換好的數(shù)據(jù)塊放入發(fā)送緩沖區(qū),同時在適當?shù)牡胤?/p>
摘要:為了解決pci9052和雙口ram之間讀寫時序不匹配的問題,本設計采用可編程器件來實現(xiàn)它們之間的接口電路。此電路可以使系統(tǒng)更加緊湊。核心邏輯部分采用有限狀態(tài)機實現(xiàn),使控制邏輯直觀簡單,提高了設計效率。 通過仿真工具modelsim se對該接口電路進行了驗證,得出的仿真波形符合要求。 o 引言 idt70v28l(雙口ram)的存取時間大于20ns,pci9052工作于25mhz,其存取時間要大于雙口ram的存取時間。pci9052是發(fā)起交易的主動者,相當于一個慢速器件訪問快速器件,通過可編程器件,可以把pci9052讀寫控制信號直接傳遞給idt70v28l,完成時序的匹配。 為將pci9052的局部邏輯轉換為雙口ram的讀寫控制信號和地址信號,本設計采用了可編程器件來實現(xiàn)它們之間的接口邏輯電路。在可編程器件設計中,狀態(tài)機的設計方法是應用最廣泛的設計方法之一。有限狀態(tài)機是一種簡單、結構清晰、設計靈活的方法,它易于建立、理解和維護,特別應用在具有大量狀態(tài)轉移和復雜時序控制的系統(tǒng)中,更顯其優(yōu)勢。鑒于其優(yōu)勢,本設計采用了verilog hdl描述的狀態(tài)機來實現(xiàn)該接口的時序邏