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DS92LV1224 40-66 MHz 10 Bit Bus LVDS Serializer... NSC DS92LV1224PDF下載
DS92LV1224 30-66 MHz 10 Bit Bus LVDS Deserializ... NSC [National Semiconductor] DS92LV1224PDF下載
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DS92LV1224TMSA 40-66 MHz 10 Bit Bus LVDS Serializer... NSC DS92LV1224TMSAPDF下載
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DS92LV1224TMSAX DS92LV1224 30-66 MHz 10 Bit Bus LVDS... National Semiconductor Corporation DS92LV1224TMSAXPDF下載
DS92LV1224TMSA/NOPB 660Mbps Deserializer 1 Input 10 Outp... DS92LV1224TMSA/NOPBPDF下載

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視頻信號數字化光纖傳輸實驗裝置的研制
定為32mhz,由fpga提供。信號由ain管腳輸入，d0~d7輸出轉換后的8位二進制數據。stby和three-state腳接地，以保證芯片正常工作。clapmin接地，把消隱電平鉗位為0電平，其電路如圖4所示。圖4 a/d轉換電路 2.4 信號發(fā)送部分由fpga處理后的數據要通過光纖發(fā)送，不需先將并行數據轉換為串行數據，再將串行數據轉換為光信號。 2.4.1 并/串轉換電路采用串化器ds92lv1023集成芯片實現，電路如圖5所示，其對應接收端由解串器ds92lv1224集成芯片完成。ds92lv1023可以將10位并行數據轉換為串行差分數據流，該差分數據流可以由ds92lv1224還原為10位的并行數據。這一組芯片內部有鎖相環(huán)，可以為數據輸出自己匹配時鐘。串化器lv1023參考時鐘選為32mhz,數據在該時鐘頻率下輸入，其芯片內部匹配產生數據輸出時鐘，每一個10位并行數據轉換為12位串行數據，其中多出一個起始位和一個終止位，所以有效頻率為320 m.解串器的參考時鐘定為16mhz,以滿足數據傳輸需求。圖5 并/串轉換電路圖由于視頻信號是實時不斷

DS92LV1224
具有300～660Mbit/s吞吐率的30～66MHz單1：10串并轉換器；具有嵌入式時鐘用于特殊噪聲抗擾低EMI的Robust總線LVDS串行數據傳輸；時鐘恢復從PLL鎖存至隨即數據模式；保證連接點每一個數據傳輸周期；低功耗<300mW(標準值)、66MHz；單差分線對消除多通道偏斜，同步模式和鎖指定，當電源關閉時高阻抗驅動器輸出；可編程邊緣觸發(fā)時鐘；小型28引腳SSOP封裝