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ds92lv1023中文資料

  • 視頻信號數(shù)字化光纖傳輸實驗裝置的研制

    同樣采用美國模擬器件公司出品的集成ad9280來實現(xiàn),其工作時鐘頻率設(shè)定為32mhz,由fpga提供。信號由ain管腳輸入,d0~d7輸出轉(zhuǎn)換后的8位二進制數(shù)據(jù)。stby和three-state腳接地,以保證芯片正常工作。clapmin接地,把消隱電平鉗位為0電平,其電路如圖4所示。 圖4 a/d轉(zhuǎn)換電路 2.4 信號發(fā)送部分 由fpga處理后的數(shù)據(jù)要通過光纖發(fā)送,不需先將并行數(shù)據(jù)轉(zhuǎn)換為串行數(shù)據(jù),再將串行數(shù)據(jù)轉(zhuǎn)換為光信號。 2.4.1 并/串轉(zhuǎn)換 電路采用串化器ds92lv1023集成芯片實現(xiàn),電路如圖5所示,其對應(yīng)接收端由解串器ds92lv1224集成芯片完成。ds92lv1023可以將10位并行數(shù)據(jù)轉(zhuǎn)換為串行差分數(shù)據(jù)流,該差分數(shù)據(jù)流可以由ds92lv1224還原為10位的并行數(shù)據(jù)。這一組芯片內(nèi)部有鎖相環(huán),可以為數(shù)據(jù)輸出自己匹配時鐘。串化器lv1023參考時鐘選為32mhz,數(shù)據(jù)在該時鐘頻率下輸入,其芯片內(nèi)部匹配產(chǎn)生數(shù)據(jù)輸出時鐘,每一個10位并行數(shù)據(jù)轉(zhuǎn)換為12位串行數(shù)據(jù),其中多出一個起始位和一個終止位,所以有效頻率為320 m.解串器的參考時鐘定為16mhz,以滿足數(shù)據(jù)

  • DS92LV1023

    DS92LV1023引腳圖40~66MHz單10:1串行器具有400~660Mbit/s吞吐量;具有嵌入式時鐘用于特殊噪聲抗擾低EMI的Robust總線LVDS串行數(shù)據(jù)傳輸;保證連接點每一個數(shù)據(jù)傳輸周期;低功耗<250mW標(biāo)準(zhǔn)值、66MHz;單差分線對消除多通道偏斜;可編程邊緣觸發(fā)時鐘;當(dāng)電源關(guān)閉時高阻抗驅(qū)動器輸出;總線LVDS串行輸出額定用于27Ω負載;小型28引腳SSOP封裝

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