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的通用處理平臺。擬定cdma解擴(kuò)解調(diào)模塊的總體方案框圖如圖2.1所示。 中頻agc單元控制70mhz中頻輸入信號的輸入能量,經(jīng)器件ad6640采樣后送入fpga信號處理模塊進(jìn)行數(shù)字下變頻到i/q路基帶,再將i/q路基帶信號送入并行檢測模塊進(jìn)行用戶檢測;并行檢測模塊采用大規(guī)模可編程邏輯器件altera公司的ep2c70f672來實現(xiàn),主要是通過并行匹配濾波器來完成搜索范圍之內(nèi)的pn碼,被檢測出來的pn碼再反饋送入fpga信號處理模塊進(jìn)行解擴(kuò)解調(diào)處理。fpga信號處理模塊采用altera公司的ep2s60f672來實現(xiàn),該部分由16個模塊組成,每一個模塊都可以完成地址碼捕獲與跟蹤、相關(guān)解擴(kuò)、相位估計、基帶解調(diào)等功能,輸出維特比軟判決數(shù)據(jù)信號;主控單元也在ep2s60f672中設(shè)計實現(xiàn),該單元完成dds控制、adc采樣頻率配置、載頻初始化配置、地址碼配置、工作狀態(tài)檢測等功能,各種配置與檢測信息通過網(wǎng)絡(luò)接口用計算機(jī)控制輸入。無線soc開發(fā)平臺499元 s3c44b0 arm7開發(fā)板378元 s3c2410 arm9開發(fā)板780元 at91sam7s64 arm7 圖2 cdma信號接收設(shè)備總體方
的軟件流程是根據(jù)ad9516的讀時序,寫入讀指令,最后由讀模塊讀取ad9516的寄存器數(shù)值。具體fpga設(shè)計如圖2所示。 在完成fpga設(shè)計后,由于整個系統(tǒng)控制都是由dsp完成,因此需對dsp進(jìn)行編程。以下給出部分dsp(ts一201)的寫ad9516的程序代碼,其中系統(tǒng)寄存器配置為0x189067:64位總線,慢速協(xié)議。 最后根據(jù)fpga設(shè)計,利用quartus ii仿真,寫ad9516模塊的軟件仿真如圖3所示。fpga采用ahera公司的stratixtm ii系列的一款ep2s60f672器件。其仿真結(jié)果與ad9516的寫時序完全吻合。 4 結(jié)語 交叉采樣系統(tǒng)時鐘源性能是決定整個采樣系統(tǒng)指標(biāo)的關(guān)鍵?;诖?,本文提出了利用ad9516給高速a/d轉(zhuǎn)換提供采樣時鐘的設(shè)計方案。實踐證明,利用這種方法產(chǎn)生的時鐘能夠滿足四通道a/d轉(zhuǎn)換實現(xiàn)440 mhz的交叉采樣的時鐘要求,可供其他高速a/d轉(zhuǎn)換的設(shè)計人員借鑒。