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當前位置:維庫電子市場網(wǎng)>IC>ep2s90f1020c3 更新時間:2025-10-18 00:25:13

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ep2s90f1020c3中文資料

  • 寬帶數(shù)字接收機的研究及實現(xiàn)

    差分輸出,其100 ω匹配電阻應盡量靠近fpga引腳放置。 2.2 fpga的信號處理單元 fpga選擇altera公司的stratixii系列器件,該系列fpga特點:采用“自適應邏輯模塊”(alm)構架優(yōu)化fpga的性能及資源利用率;高速dsp模塊(最高達370 mhz),實現(xiàn)專門的乘法、乘加運算及有限脈沖響應(fir)濾波器;最多有16個全局時鐘,支持動態(tài)時鐘管理以降低用戶模式時的功耗;最多有12個鎖相環(huán)(pll)。根據(jù)該設計的數(shù)據(jù)處理要求,以及估算處理所需的資源,選用ep2s90f1020c3型fpga。 2.3 系統(tǒng)原理框圖 a/d轉換器的采樣速度為600 mhz,a/d轉換器內部通過dmux輸出300 mhz奇偶兩路送至fpga,fpga內部通過lvds模塊轉換為單端信號,然后進行數(shù)字下變頻(ddc)處理。需注意,a/d采樣得到的數(shù)字信號為偏移二進制類型,需轉換為補碼形式,以便后續(xù)處理。 ddc后得到的基帶信號進入信道化濾波器組完成信道化處理,可得到32路子帶信號,此時每個子帶信號的速率降為300~32 mhz,從而大大減輕后續(xù)信號處理負擔。圖2是fpga內部處

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