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EP2S30F672I4 IC FPGA 500 I/O 672FBGA EP2S30F672I4PDF下載
EP2S30F672C3N IC FPGA 500 I/O 672FBGA EP2S30F672C3NPDF下載
EP2S30F672C3N FPGA, STRATIX II, 30K ELEMENTS, FBGA... Altera EP2S30F672C3NPDF下載
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ep2s30f672價(jià)格行情

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ep2s30f672中文資料

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基于Camera Link接口的圖像跟蹤系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
大小的數(shù)字信號(hào)后，再對(duì)其中的目標(biāo)進(jìn)行分割、識(shí)別和跟蹤，并準(zhǔn)確計(jì)算出目標(biāo)的位置角度偏差，并傳給伺服機(jī)構(gòu)。在某系統(tǒng)中要求能對(duì)3×3像素大小的小目標(biāo)進(jìn)行精確跟蹤，為了達(dá)到跟蹤精度，可以提高圖像輸入的幀頻和提高圖像輸入的分辨率，因此前端采用了dalsa公司的一款基于camera link接口的數(shù)字?jǐn)z像機(jī)，該相機(jī)的幀頻為100 hz，分辨率高達(dá)1 400×1 024。這樣幀處理時(shí)間就只有10 ms，考慮到系統(tǒng)的實(shí)時(shí)性，我們采用了ti公司的高性能的dsp芯片tms320c6414和高性能fpga芯片ep2s30f672為核心的硬件處理平臺(tái)。 1 系統(tǒng)硬件結(jié)構(gòu)和工作原理整個(gè)圖像跟蹤模塊的結(jié)構(gòu)圖如圖1中虛線框所示，整個(gè)系統(tǒng)包括以fpga為核心的圖像采集和預(yù)處理單元，以dsp為核心的圖像處理單元以及由fpga控制的圖像顯示單元。由于采集、處理、顯示均要訪問存儲(chǔ)器，為了降低成本，用普通的異步sram構(gòu)成。按照功能來分可分為采集處理用sram組和采集顯示用sram組，每組分別包括兩片sram，其讀寫邏輯由fpga控制，采用乒乓方式進(jìn)行切換。對(duì)于采集處理部分，第k幀時(shí)，sram1由f

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