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ep2s15f484c5價格行情

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歷史最低報價:¥120.0000 歷史最高報價:¥950.0000 歷史平均報價:¥545.7142

ep2s15f484c5中文資料

  • 基于多路移相時鐘的瞬時測頻模塊設計

    臺,能滿足脈內測頻的要求,能進行遠程通信,并有一定的移植型和升級性。 整個系統(tǒng)的工作機理是:操作人員通過上位機人機界面對該模塊進行參數設置和功能選擇,人機界面的設定值通過串口傳輸到單片機,單片機作為測量模塊的控制部件,控制fpga完成相應的測量任務,fpga負責具體測頻算法實現。測試完成后,測試結果通過單片機傳送給上位機人機界面顯示,兩者通過rs232串口連接。整個設計中fpga內部的測頻算法電路為核心電路。 3 fpga測頻算法電路設計 采用altera公司stratixii系列ep2s15f484c5型fpga為核心控制單元。內部的測頻算法電路主要包括pll輸出時鐘的走線、時序控制單元、數據處理單元。這些單元是實現測頻算法的核心,需要將各單元按相互提供的接口在fpga內部進行連接,構成完整的測頻模塊,實現等精度測頻功能。輸入信號分別為10 mhz的時鐘信號、脈沖包絡信號和被測信號;輸出信號為時鐘計數值和ns被測信號計數值nx。 利用pll輸出多路計數時鐘,可在fpga內部通過pll級聯的方式增大最大倍頻數。首先利用epll將恒溫晶振輸入的10 mhz時鐘倍頻到50 mhz,傳輸給fpl

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