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在無(wú)線數(shù)傳接收設(shè)備中,數(shù)據(jù)轉(zhuǎn)存系統(tǒng)是實(shí)現(xiàn)數(shù)據(jù)接收存儲(chǔ)的關(guān)鍵子系統(tǒng)。下面將詳細(xì)介紹該系統(tǒng)的硬件實(shí)現(xiàn)及工作過(guò)程。2 數(shù)據(jù)轉(zhuǎn)存系統(tǒng)基本構(gòu)成及硬件實(shí)現(xiàn) 數(shù)據(jù)轉(zhuǎn)存系統(tǒng)主要由fpga模塊、dsp模塊、usb2.0接口芯片構(gòu)成,各個(gè)模塊之間的相互關(guān)系如圖2所示示。圖中,4mb/s的串行數(shù)據(jù)輸入信號(hào)sdi已由rs-422差分電平轉(zhuǎn)換為cmos電平。為突出重點(diǎn),不太重要的信號(hào)連線未在圖中繪出。下面分別介紹這幾個(gè)模塊的主要功能。 2.1 fpga模塊實(shí)現(xiàn)及春功能 fpga模塊在altera公司acex系列的ep1k30ti144-2芯片中實(shí)現(xiàn)。其中主要的功能子模塊有:位同步邏輯、幀同步邏輯、授時(shí)時(shí)鐘和譯碼邏輯。位同步邏輯主要由數(shù)字鎖相環(huán)構(gòu)成,用于從串行數(shù)據(jù)輸入信號(hào)sdi中恢復(fù)出位時(shí)鐘信號(hào)。幀同步邏輯從位同步邏輯的輸出信號(hào)提取幀同步脈沖。兩者為dsp利用其同步串行口接收串行數(shù)據(jù)作好準(zhǔn)備。這樣,利用一對(duì)差分信號(hào)線就可以接收同步串行數(shù)據(jù),簡(jiǎn)化了印制電路板的外部接口。授時(shí)時(shí)鐘在dsp和gsp接收機(jī)的協(xié)助下生成精度為0.1ms的授時(shí)信息。譯碼邏輯用于實(shí)現(xiàn)系統(tǒng)互聯(lián)。 2.2 dsp模塊實(shí)現(xiàn)及其功能 dsp模塊是數(shù)據(jù)轉(zhuǎn)存系統(tǒng)的主控模