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出其參考分頻比r為100。事實上，在設(shè)計時，可以利用adi公司提供的adisimpll工具計算出三階環(huán)路濾波器的元件參數(shù)如下： r1=9.46 kω，c1=173 pf，c2=2.36 nf，r2=19.3 kω，c3=79 pf。 3 adf4360_4的fpga初始化 每次給adf4360_4加電時，都必須給內(nèi)部數(shù)字寄存器寫入一定的值才能獲得需要的本振輸出。而每次掉電后，原來寫入內(nèi)部數(shù)字寄存器的值也隨之消失。所以，設(shè)計時可用fpga控制板來寫入數(shù)據(jù)。fpga可選用altera公司的ep1c3t100c6芯片，同時也可以外接20mhz的石英晶振來為其提供時鐘。fpga板上設(shè)置的5個按鍵分別為reset(復(fù)位鍵)、ce(使能鍵)、r (r輸入鍵)、c(c輸入鍵)和n(n輸入鍵)。ep1c3t100c6的雙向i／o口77、78、79分別接adf4360_4的le、data、clk，其中clk為串行時鐘輸入，data為串行數(shù)據(jù)輸入，le為加載使能，該位為邏輯“1”時表示加載，le由fpga板子上的ce使能鍵控制。每次加載數(shù)據(jù)時。應(yīng)先按reset鍵復(fù)位，然后按ce使能鍵。這樣，當(dāng)fp-ga板和adf43
參考分頻比r為100。事實上，在設(shè)計時，可以利用adi公司提供的adisimpll工具計算出三階環(huán)路濾波器的元件參數(shù)如下： r1=9.46 kω，c1=173 pf，c2=2.36 nf，r2=19.3 kω，c3=79 pf。 3 adf4360_4的fpga初始化 每次給adf4360_4加電時，都必須給內(nèi)部數(shù)字寄存器寫入一定的值才能獲得需要的本振輸出。而每次掉電后，原來寫入內(nèi)部數(shù)字寄存器的值也隨之消失。所以，設(shè)計時可用fpga控制板來寫入數(shù)據(jù)。fpga可選用altera公司的ep1c3t100c6芯片，同時也可以外接20mhz的石英晶振來為其提供時鐘。fpga板上設(shè)置的5個按鍵分別為reset(復(fù)位鍵)、ce(使能鍵)、r (r輸入鍵)、c(c輸入鍵)和n(n輸入鍵)。ep1c3t100c6的雙向i／o口77、78、79分別接adf4360_4的le、data、clk，其中clk為串行時鐘輸入，data為串行數(shù)據(jù)輸入，le為加載使能，該位為邏輯“1”時表示加載，le由fpga板子上的ce使能鍵控制。每次加載數(shù)據(jù)時。應(yīng)先按reset鍵復(fù)位，然后按ce使能鍵。這樣，當(dāng)fp-ga板和adf43
00。事實上，在設(shè)計時，可以利用adi公司提供的adisimpll工具計算出三階環(huán)路濾波器的元件參數(shù)如下： r1=9.46kω，c1=173pf，c2=2.36nf，r2=19.3kω，c3=79pf。 3adf4360_4的fpga初始化 每次給adf4360_4加電時，都必須給內(nèi)部數(shù)字寄存器寫入一定的值才能獲得需要的本振輸出。而每次掉電后，原來寫入內(nèi)部數(shù)字寄存器的值也隨之消失。所以，設(shè)計時可用fpga控制板來寫入數(shù)據(jù)。fpga可選用altera公司的ep1c3t100c6芯片，同時也可以外接20mhz的石英晶振來為其提供時鐘。fpga板上設(shè)置的5個按鍵分別為reset(復(fù)位鍵)、ce(使能鍵)、r(r輸入鍵)、c(c輸入鍵)和n(n輸入鍵)。ep1c3t100c6的雙向i／o口77、78、79分別接adf4360_4的le、data、clk，其中clk為串行時鐘輸入，data為串行數(shù)據(jù)輸入，le為加載使能，該位為邏輯“1”時表示加載，le由fpga板子上的ce使能鍵控制。每次加載數(shù)據(jù)時。應(yīng)先按reset鍵復(fù)位，然后按ce使能鍵。這樣，當(dāng)fp-ga板和adf436
的衰減，db13、db12兩位設(shè)置為“10”，則輸出信號功率為-6 dbm。 3.2 adf4360-4的fpga初始化 adf4360-4每次上電時必須給內(nèi)部數(shù)字寄存器寫入數(shù)值才能獲得所需的本振輸出。而每次掉電后，原來寫入內(nèi)部數(shù)字寄存器的值也就丟失，所以選擇現(xiàn)成的fpga控制板寫人數(shù)據(jù)。fpga采用alter公司的eplc3t100c6。外接20 mhz石英晶體振蕩器提供時鐘。fpga上設(shè)置了5個按鍵，分別為reset(復(fù)位)、ce(使能)、r(r輸入)、c(c輸入)以及n(n輸入)。ep1c3t100c6的雙向i／o口77、78、79分別與adf4360-4的le、data、clk相連。其中clk為串行時鐘輸入；data為串行數(shù)據(jù)輸入：le為加載使能，該位為邏輯“1”時加載，le是由fpga上的ce使能位控制。每次加載數(shù)據(jù)時，先按reset復(fù)位，然后按ce使能，fpga與adf4360-4相連傳輸數(shù)據(jù)，然后依次按下r、c、n寫入數(shù)據(jù)。 數(shù)據(jù)寫入時序：data在每個clock的上升沿從msb(最高有效位)開始依次寫入24位移位寄存器中的數(shù)據(jù)并一次鎖存到目標(biāo)寄存器，再開始下一個目標(biāo)寄存器的初始
2所示的單元完成了等精度測頻的核心部分，在實際應(yīng)用中多數(shù)時候需要將測量的結(jié)果通過顯示設(shè)備進行顯示。從圖2可以看出本設(shè)計由于設(shè)計了鎖存單元，將計數(shù)結(jié)果和一些控制信號進行了鎖存處理，便于與單片機或者其他的單片機(mcu)相連，因此在該fpga實現(xiàn)的核心單元基礎(chǔ)上連接mcu，容易實現(xiàn)計數(shù)值到實際頻率值以及相應(yīng)的周期值之間的轉(zhuǎn)換，并通過mcu控制顯示設(shè)備將最終需要顯示的結(jié)果信息進行顯示。fpga器件與單片機硬件接口電路框圖如圖3所示。圖3中的等精度頻率測量模塊和鎖存模塊都由altera公司的fpga器件ep1c3t100c6實現(xiàn)，等精度計數(shù)模塊的輸出結(jié)果為2個32 bit的數(shù)據(jù)，為了方便與單片機連接，該2個32 bit數(shù)據(jù)由在fpga器件內(nèi)部的鎖存器分8次鎖存輸出，單片機每次讀取8 bit，連續(xù)讀取8次即可，讀取的nx和n0的計數(shù)值經(jīng)過單片機按照等精度頻率計算公式換算成實際頻率值，最后通過dm12864進行顯示。 3 測量結(jié)果的誤差分析 采用高精度信號源輸出不同頻率的正弦波信號，經(jīng)過信號調(diào)理電路，整形得到的方波信號提供給fpga進行計數(shù)測量，將測量結(jié)果與高精度信號源輸出的頻率相比較，計算其誤差，如表
請問一下用fpga對圖像數(shù)據(jù)處理的問題我想用ep1c3t100c6采集一個50mhz頻率的圖像信號, 圖像大小有1m-2m的樣子,現(xiàn)在想外加二個sdram, 作為緩沖; 還后再處理成想要的視頻格式;請問ep1c3t100c6能把圖像采集出來嗎? 要不要加二個sdram緩沖(用sram可不可以)?
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