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ISL5217 Datasheet

  • ISL5217

  • Quad Programmable Up Converter

  • 799.82KB

  • 43頁

  • INTERSIL   INTERSIL

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ISL5217
TABLE 49. COEFFICIENT ADDRESSES
DS[n]
IP0
IP1
IP2
IP3
IP4
IP5
IP6
IP7
IP8
IP9
IP10
IP11
IP12
IP13
IP14
IP15
0
1
2
3
4
5
6
7
8
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11
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14
15
DS[n-1]
16
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26
27
28
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30
31
DS[n-2]
32
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46
47
DS[n-3]
48
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63
DS[n-4]
64
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67
68
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73
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76
77
78
79
...
...
...
...
...
...
...
...
...
...
...
...
...
...
...
...
...
DS[n-12]
192
193
194
195
196
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198
199
200
201
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205
206
207
DS[n-13]
208
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210
211
212
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223
DS[n-14]
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230
231
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235
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DS[n-15]
240
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242
243
244
245
246
247
248
249
250
251
252
253
254
255
TABLE 50. REVISION HISTORY
REVISION NUMBER
6004.2
REVISION DATE
February 20, 2003
REVISION DESCRIPTION
- Added a NOTE in the Pinout Diagram
- See the note for CS pin description and Microprocessor Interface section
- Figure 11, 鈥淩e-sampling NCO Block Diagram鈥?-- corrected bit-weights
- Table 8, 鈥淚nput/Output Modes鈥?-- corrected
- Corrected the NOTE 3 in 鈥淎bsolute Maximum Ratings鈥?Table
- Table 49, 鈥淐oefficient Addresses鈥?-- corrected
- Appendix A added
41

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