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ISL5217 Datasheet

  • ISL5217

  • Quad Programmable Up Converter

  • 43頁

  • INTERSIL   INTERSIL

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Functional Block Diagram
ISL5217
SCLKA
FSRA
INTERFACE
I IN<15:0>
Q IN<15:0>
MUX
INTERPOLATION
FILTER
SDA
SDB
SDC
SDD
MUX
SERIAL
FM
MOD.
I FM
18
/
Q FM 18
/
I SF 20
/
SHAPING
FILTER
LIMITER
MUX
1-7 DEEP
FIFO
20
/
20
/
MUX
HALF
BAND
21
/ COMPLEX
21
MIXER
/
GAIN CONTROL
GAIN PROFILE
I<21:0>
Q<21:0>
4 INPUT
SUMMER
1
I IN<15:0>
Q IN<15:0>
SER._PAR.
/
16
I FIFO /
/
Q FIFO 16
/
COS<18:0>
CHANNEL
UP
INTERFACE
AND TIMING
OUTPUT_EN
CARRIER PHASE<15:0>
CARRIER FREQUENCY<31:0>
DUALQUADMODE (CH0 AND CH2 ONLY)
ROUTEBUS_UPDATE
CARRIER
NCO
CHANNEL 0
I<21:0>
Q<21:0>
CH_EN<1>
I<21:0>
Q<21:0>
CH_EN<2>
I<21:0>
Q<21:0>
CH_EN<3>
SIN<18:0>
COARSE
PHASE<3:0>
FINE
PHASE<11:0>
ROUTING
CONTROL
PROGRAMMABLE DELAY
TX_ENABLE<3:0>
UPDATE<3:0>
CH_SELECT<3:0>
<4:0>
2
CLK
A<6:0>
P<15:0>
TXENA
TXENB
TXENC
TXEND
UPDA
UPDB
UPDC
UPDD
WR
RD
CS
RESET
RDMODE
OUTEN<1:0>
TRITST
OFFBIN
TMS
TDI
TCK
TRST
BYPASS
CH_ENABLE<0>
MOD. TYPE <1:0>
FID<31:0>
SR<47:0>
SAMPLE
INTPL PHASES<1:0>
NCO
PHASE OFFSET<1:0>
GAIN<11:0>
GAIN PROFILE LENGTH<6:0>
ISL5217
CHANNEL 1
4 INPUT
SUMMER
2
4 INPUT
SUMMER
3
4 INPUT
SUMMER
4
SCLKB
FSRB
SCLKC
FSRC
SCLKD
FSRD
ISTRB
CHANNEL 2
ISTROBEUPDATE
RESET
CASCADE_DELAY<1:0>
ROUTEBUS<15:0>
CASCADE_IN_ENABLE
OUTPUTMODE<1:0>
OUTPUTMODE2X
I_STROBE_EN
ISTROBEPOLARITY
TRITST_ENABLE_BUS<7:0>
CHANNEL 3
DEVICE
UPROCESSOR
INTERFACE
OUTPUT
CONTROL
IOUT<19:0>
QOUT<19:0>
IIN<19:0>
QIN<19:0>
SYNCO
JTAG
TDO

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