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僅上升部分延遲的接通遲電路圖

出處:forsuccess 發(fā)布于:2009-10-29 00:00:00 | 3078 次閱讀

  圖1是僅在ON時延遲的電路——接通延遲電路,僅在電阻R上并聯(lián)二極管D,如果改變二極管的方向,如圖2所示,就變成了僅在OFF時延遲的電路——斷開延遲電路。

  圖1 僅上升部分延遲的接通延遲電路

僅上升部分延遲的接通延遲電路

  圖2僅下降部分延遲的斷開延遲電路

僅下降部分延遲的斷開延遲電路

  這種延遲電路中的二極管實現(xiàn)切換充放電時間的動作。二極管不導(dǎo)通時,T=RC;導(dǎo)通時,CMOSIC的輸出阻抗+二極管D的動作阻抗(可忽略),可以極端地縮短時間常數(shù)。

  圖3是接通延遲時的電容C端子電壓波形。橫切閾值電壓VN,的時間為接通延遲時間約(10μs),橫切怖時電壓急劇上升,幾乎沒有延遲。

  圖3 斷開延遲電路的電容C端子電壓波形

斷開延遲電路的電容C端子電壓波形

  這種電路輸人T=RC以下的脈沖列不出現(xiàn)輸出,因此可適用于去掉幅度狹小的脈沖、噪聲等。

  另一方面,斷開延遲電路為拉長脈沖寬度,需拉長幅度狹小的脈沖列。

  圖4是觀測斷開延遲時的電容C端子電壓波形圖。OFF后橫切Vp,的時間(約10ps)為斷開延遲時間。

  圖4 斷開延遲電路的電容C端子電壓波形

斷開延遲電路的電容C端子電壓波形

 ?。≧=10kΩ,C=1000pF,2V/div,10μs/div)



  
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