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基于FPGA的IRIG-B編碼器的設(shè)計
寬度為5 ms的脈沖表示邏輯1，用寬度為2：ms的脈沖表示邏輯0。如圖1所示，交流碼的載波是1 khz正弦信號，幅度變化峰一峰值范圍為0.5～10 v。調(diào)制比為u1／u0=1／6～1／2，即邏輯1是5個幅度為u1的1 khz正弦信號，邏輯0是2個幅度為u1的1 khz正弦信號，索引標(biāo)記是8個幅度為u1的1 khz正弦信號，其他時間是幅度為u0的1 khz正弦信號。 2 系統(tǒng)方案 2.1 系統(tǒng)原理框圖設(shè)計授時系統(tǒng)需要一個精準(zhǔn)時基。在此利用精密授時型gps引擎m12t作為系統(tǒng)時基，利用alterafpga檢測m12t輸出的百分秒(100 pps)同步信號和經(jīng)串口輸出的絕對時間信號，編碼后輸出到dc／ac接口模塊，再輸出到物理鏈路，系統(tǒng)結(jié)構(gòu)圖如圖2所示。上述系統(tǒng)首先實現(xiàn)了b碼直流編碼，而后在直流碼的基礎(chǔ)上實現(xiàn)交流調(diào)制，以得到交流碼，同時提供恢復(fù)每秒脈沖數(shù)輸出和隔離rs 232串行口輸出且符合motorola格式的時間碼，以及數(shù)碼管的時間顯示。時間顯示部分用fpga實現(xiàn)比較簡單，下文不再詳述。 2.2 gps授時模塊m12t m12接
組合GPS引擎和FPGA的IRIG-B編碼器實現(xiàn)
引標(biāo)記，用寬度為5 ms的脈沖表示邏輯1，用寬度為2 ms的脈沖表示邏輯0。如圖1所示，交流碼的載波是1 khz正弦信號，幅度變化峰-峰值范圍為0．5～1 0 v。調(diào)制比為u1／u0=1／6～1／2，即邏輯1是5個幅度為u1的1 khz正弦信號。邏輯0是2個幅度為己u1的1 khz正弦信號，索引標(biāo)記是8個幅度為u1的1 khz正弦信號，其他時間是幅度為u0的1 khz正弦信號。 2 系統(tǒng)方案 2．1 系統(tǒng)原理框圖設(shè)計授時系統(tǒng)需要一個精準(zhǔn)時基。在此利用精密授時型gps引擎m12t作為系統(tǒng)時基，利用alterafpga檢測m12t輸出的百分秒(100 pps)同步信號和經(jīng)串口輸出的絕對時間信號，編碼后輸出到dc／ac接口模塊，再輸出到物理鏈路，系統(tǒng)結(jié)構(gòu)圖如圖2所示。上述系統(tǒng)首先實現(xiàn)了b碼直流編碼，而后在直流碼的基礎(chǔ)上實現(xiàn)交流調(diào)制，以得到交流碼，同時提供恢復(fù)每秒脈沖數(shù)輸出和隔離rs 232串行口輸出且符合motorola格式的時間碼，以及數(shù)碼管的時間顯示。時間顯示部分用fpga實現(xiàn)比較簡單，下文不再詳述。 2．2 gps授時模塊m12t m12接收器是m

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