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上升沿到來時，dir進行加1計數(shù)，且當dir=0xf時，dir的下一狀態(tài)值為0。與此同時，dir加1并賦值給direct。 當lamp為低電平時，電梯處于等待狀態(tài)，故liftor保持其原值不變保持0和3不變；當lamp為高電平時，電梯處于運行狀態(tài)，因upin始終為高電平，downin始終為低電平，故當run_stop為高電平時，電梯只能處于上升狀態(tài)，故liffor進行自加1計數(shù)，同時，liftor加1賦值給 st_out。 5 硬件實驗 在max+plusii軟件編譯完后，采用epm7128slc84-6器件下載vhdl源程序，進行硬件試驗。 其下載步驟為：首先，指定采用可編程器件epm7128slc84-6；其次，依據(jù)輸入、輸出端口指定與之對應的引腳；然后，使用pof2jed軟件將編譯后的下載文件*．pof。轉(zhuǎn)換成*．jed文件；最后，使用atmel isp軟件將轉(zhuǎn)換后的*．jed文件轉(zhuǎn)換成*．chn文件。 硬件系統(tǒng)試驗表明，輸出信號的顯示與軟件仿真結(jié)果完全相符，達到設計要求。 6 結(jié)論 該系統(tǒng)軟件設計中，成功編譯并仿真vhdl源程序，且對仿真圖進行合理分析。在硬件實驗
'event and clk='1')then if cnt<999 then cnt:=cnt+1; clk1ms<='0'; else cnt:=0; clk1ms<='1'; end if; end if; end process p2; end control; 三、功能仿真及下載驗證 各模塊vhdl程序經(jīng)過編譯優(yōu)化后，選擇合適的目標芯片進行綜合、管腳配置。本電路選用altera公司的可編程邏輯芯片epm7128slc84-6，由max+plus ii進行仿真，從仿真波形可以看出，此程序可以實現(xiàn)四種不同花樣彩燈的相互變換，每種花樣彩燈可以循環(huán)變化。但是如果系統(tǒng)的固有頻率很大，彩燈的閃爍速度非?？欤吹降默F(xiàn)象是每個花樣的八個彩燈同時被點亮，為了實現(xiàn)絢麗多彩的景象，必須要在程序中加一個分頻進程如上述程序的進程p2。 四、結(jié)束語 本次設計的程序已經(jīng)在硬件系統(tǒng)上得到了驗證，實驗表明。此設計方法能夠滿足四種不同花樣彩燈的變化要求，并且該方法便于擴展不同變化模式的彩燈花樣，各個不同花樣的相互轉(zhuǎn)變是手動切換實現(xiàn)的。自動
2c的時序要求。要使總線傳輸速率達到改進后的規(guī)范，即400 kb/s，因為根據(jù)以上敘述，每發(fā)送1位數(shù)據(jù)需要4個時鐘周期，所以所給的時鐘為1600 khz。圖4中execute為執(zhí)行信號，即它為高電平時，輸入數(shù)據(jù)din[7..0]有效；exu為發(fā)送使能信號，只有當它為高電平時，方可輸送串行數(shù)據(jù)到外圍器件；start為開始控制信號，用于發(fā)生起始信號；stop用于告知總線數(shù)據(jù)傳輸結(jié)束，發(fā)生停止信號。圖4 仿真結(jié)果 仿真以后，通過編程電纜將生成的pof文件用isp(在系統(tǒng)編程)方式下載到fpga板epm7128slc84-6，i/o口sda和scl掛上拉電阻，外接兩片i2c器件saa1064(led顯示i2c串入并出芯片)進行測試，結(jié)果cpld利用該i2c的ip核，工作正常，可以按照要求顯示。 來源:零八我的愛
、1表示密碼正確、8表示修改密碼成功。acc為內(nèi)部移位寄存器。臨時存儲4個4位二進制數(shù)，用于暫存用戶輸入的密碼；reg為內(nèi)部移位寄存器，臨時存儲4個4位二進制數(shù)，用于保存密碼；nc為內(nèi)部信號，用于表示當前已輸入數(shù)據(jù)數(shù)．或者表示用戶按數(shù)字鍵的次數(shù)。 根據(jù)圖5所示的總體仿真圖，可導出密碼控制系統(tǒng)電路，如圖6所示。 4 結(jié)語 本系統(tǒng)設計是通過自動調(diào)用max-7000s系列的epm7128slc84-6型epga器件來實現(xiàn)。并且通過系統(tǒng)總體仿真圖能看出設計的密碼控制系統(tǒng)完全符合要求。 參考文獻:[1]. 110l datasheet http://www.udpf.com.cn/datasheet/110l_2043496.html.來源:qick
；按下"開啟電器編號"設置鍵，再按下要定時開啟的電器編號，對應發(fā)光二極管亮，表示設置有效；按下"電器開啟時間"設置按鍵；再依次輸入4位十進制的小時和分鐘，作為開啟時間；按下"電器關閉時間"設置按鍵，再依次輸入4位十進制的小時和分鐘，作為關閉時間。至此定時開關設置完成，對于電飯鍋等具有保持功能的電器，則不用設置定時關閉。使用verilog hdl編寫cpld程序，理論上可同時設置多個電器的定時自動開啟，本設計可同時設置3個電器。 3硬件設計 硬件設計采用altera公司的cpld epm7128slc84-6，簡化了外圍電路，穩(wěn)定性和可靠性高，成本低。220 v、50 hz工頻電源經(jīng)變壓器、電橋整流后通過三端穩(wěn)壓器，提供工作電壓，其電源電路如圖1所示。 外接4×4鍵盤，使用較少的i／o端口線就可實現(xiàn)對較多按鍵的控制。當有鍵按下時，kb為低電平，cpld的按鍵掃描部分采用動態(tài)掃描方式進行識別。設置14個按鍵，分別為0～9十個數(shù)字鍵和設定時間、開啟電器編號、電器開啟時間、電器關閉時間4個功能鍵，其余兩個留作功能擴展。4×4鍵盤電路如圖2所示。 本系統(tǒng)設計使用6個數(shù)碼管顯示時間，3個
…… 器件用的是epm7128slc84-6
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