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高分辨率時間數(shù)字轉(zhuǎn)換電路的PLD實現(xiàn)
數(shù)據(jù)中，測量系統(tǒng)可以分辨出4.14－4.49ns的脈寬差，說明硬件的實際分辨率高于仿真結(jié)果，圖5是圖4中信號周期從160－210ns時的放大圖，可以看出計數(shù)值無跳碼，只有很小的波動，表示設(shè)計是完全合理可行的。由于7000s是慢速電路，按照此測量結(jié)果，如果采用max7000系列的芯片，完全可以達(dá)到或高于仿真結(jié)果表明的3.5ns的分辨率。通過仿真和硬件測試表明，該設(shè)計系統(tǒng)能夠準(zhǔn)確計數(shù)，各項功能均達(dá)到預(yù)期的要求，整個設(shè)計的正確性和完整性得到驗證，經(jīng)優(yōu)化后的設(shè)計，以max系列epm7064lc44－7為目標(biāo)芯片的綜合報告顯示，其1250個門用了54％，轉(zhuǎn)換率最高可達(dá)3.5ns，這表明本文的設(shè)計思想和實現(xiàn)方法是可行的。 5 結(jié)語采用8個與門電路結(jié)構(gòu)rgds實現(xiàn)的16位tdc系統(tǒng)，才保證計數(shù)器穩(wěn)定的前提下，使rgds中單門延時的離散可能性大大減小。本設(shè)計max系列芯片max7000上實現(xiàn)了最高分辨率為3.5ns的tdc系統(tǒng)，仿真數(shù)據(jù)和硬件測試均表明計數(shù)結(jié)果穩(wěn)定準(zhǔn)確，由于采用vhdl語言實現(xiàn)設(shè)計，所以本設(shè)計可方便地移植到其他基于pld的設(shè)計中。來源:xiangxueqin

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