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美信新款時鐘發(fā)生器適于低抖動輸出xDSL設(shè)備應(yīng)用
美信集成產(chǎn)品(maxim integrated products)公司近日推出一款高效費比、高性能時鐘發(fā)生器——max9486，其輸入?yún)⒖紩r鐘頻率為8khz，適用于需要低抖動輸出的adsl/vdsl局端線路卡、t1/e1、t3/e3和電信網(wǎng)絡(luò)系統(tǒng)設(shè)備。 max9486采用17.664mhz的晶體和8khz輸入?yún)⒖紩r鐘信號產(chǎn)生6個一致的35.328mhz緩沖lvttl輸出，這些35.328mhz輸出信號與8khz輸入時鐘信號完全同步。max9486有一個集成的17.644mhz vcxo，它的驅(qū)動范圍很寬，因而輸入?yún)⒖歼_(dá)±200ppm。 max9486還提供低抖動的8khz時鐘輸出，供系統(tǒng)的其它部分當(dāng)參考時鐘用。該時鐘發(fā)生器可自動檢測8khz參考信號的有無，并將輸出clk信號鎖定在35.328mhz，精度±25ppm。與該系列合成器系列的其它ic一樣，max9486的輸入時鐘為8khz，并且在15mhz至78mhz范圍內(nèi)與多個緩沖輸出頻率同步。 max9486采用24引腳tssop封裝，以單電源供電，正常工作溫度范圍在-40℃至+85℃。1000片以上采購時，美國fob起價6.14美
ADSL收發(fā)器片上系統(tǒng)芯片的設(shè)計與實現(xiàn)
與內(nèi)部arm核通信。dpll的功能有：(1)dpll中恢復(fù)導(dǎo)頻信號的功能。為了保證收發(fā)時鐘有固定的相位關(guān)系，在adsl中采用了插入導(dǎo)頻的方法來傳送和恢復(fù)時鐘信號。發(fā)送器在發(fā)送數(shù)據(jù)的同時用64號子信道傳送獨立的導(dǎo)頻信號，抽樣時鐘頻率為2208khz，而導(dǎo)頻信號的頻率為276khz，恢復(fù)了導(dǎo)頻信號后，利用鎖相環(huán)鎖住抽樣時鐘頻率，從而實現(xiàn)時鐘的恢復(fù)。(2)在pll中通過一個時鐘源產(chǎn)生內(nèi)部的所需時鐘。其中內(nèi)部所需時鐘包括：cpu時鐘、dsp時鐘、各種算法的時鐘等。pll鎖相環(huán)的外界參考晶體的頻率可以為：35.328mhz。在trellis編碼和viterbi解碼時，分別有一個誤碼計數(shù)器與之相連，當(dāng)發(fā)生錯誤時，誤碼計數(shù)器加1，加到一定數(shù)值，就通過發(fā)送中斷信號t_int5、r_int5通知內(nèi)部arm核。 3 非對稱數(shù)字用戶環(huán)路收發(fā)器的片上系統(tǒng)芯片設(shè)計難點3.1 dsp算法設(shè)計及實現(xiàn)dsp算法是adsl收發(fā)器soc芯片的核心其工作的好壞直接影響整個芯片的性能而adsl收發(fā)器中涉及的dsp技術(shù)又非常復(fù)雜給設(shè)計增加了難度。dsp算法的設(shè)計首先要建立算法模型，以模型為基礎(chǔ)進(jìn)行算法設(shè)計，繼而設(shè)計優(yōu)化模型并

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