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ISL6537 Datasheet

  • ISL6537

  • ACPI Regulator/Controller for Dual Channel DDR Memory System...

  • 15頁

  • INTERSIL   INTERSIL

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SLP_S3#
SLP_S5#
8
FN9142.4
February 8, 2005
12V
POR
12V
0V
V
DDQ_DDR
0V
V
DDQ_DDR
V
TT_DDR
0V
V
TT_DDR
Soft Start Rise Time Dependent Upon Capacitor On V
REF_IN
Pin
ISL6537
V
TT_DDR
FLOATING
V
GMCH_UPPER
0V
V
GMCH
0V
V
TT_GMCH/CPU
0V
VIDPGD
t
0
(3 SOFTSTART CYCLES)
t
1
t
2
t
3
t
4
t
5
t
6
t
7
t
8
(3 SOFTSTART CYCLES)
t
10
t
9
t
11
t
12
t
13
t
14
t
15
FIGURE 1. ISL6537 TIMING DIAGRAM

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