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基于FPGA技術(shù)的數(shù)字相關(guān)器的設(shè)計(jì)與實(shí)現(xiàn)
用vhdl設(shè)計(jì)數(shù)字相關(guān)器用vhdl設(shè)計(jì)數(shù)字相關(guān)器的邏輯框圖如圖2所示。圖2 字相關(guān)器的邏輯框圖本文用vhdl設(shè)計(jì)的數(shù)字相關(guān)器,僅需一個(gè)數(shù)據(jù)時(shí)鐘,避免了復(fù)雜的時(shí)序控制,它采用適時(shí)運(yùn)算處理,所得相關(guān)峰的寬度是一個(gè)數(shù)據(jù)比特,比較容易捕獲,不會(huì)產(chǎn)生丟峰漏峰等不良現(xiàn)象,提高了相關(guān)器的可靠性。下面給出32－bit數(shù)字相關(guān)器的部分vhdl源程序。 4 fpga實(shí)現(xiàn)32-bit數(shù)字相關(guān)器本設(shè)計(jì)選用xc4044xla fpga芯片實(shí)現(xiàn),開發(fā)工具是xilinx公司的foundationseries3．1i。相關(guān)器僅占該芯片部分資源,該芯片其余資源為同步系統(tǒng)中其它部件所用。下面給出該相關(guān)器測(cè)試結(jié)果。給相關(guān)器設(shè)置32位相關(guān)碼：將0f7adh、96e8h依次由低到高置入相關(guān)碼寄存器中,其接收數(shù)據(jù)中的獨(dú)特碼與相關(guān)碼相同,測(cè)試結(jié)果如圖3所示。圖3測(cè)試結(jié)果 5 結(jié)束語用vhdl設(shè)計(jì)在fpga芯片中實(shí)現(xiàn)數(shù)字相關(guān)器,簡(jiǎn)化了相關(guān)器復(fù)雜的邏輯電路設(shè)計(jì),降低了相

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