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ine outw(data,addr)((*(volatile unsigned short*)(addr))=(data))#define outl(data,addr)((*(volatile unsigned short*)(addr))=(data))#define outl(data,addr)((*(volatile unsigned long*)(addr))=(data))分別是8位、16位、32位數(shù)據(jù)總線的寫函數(shù)。3 應用實驗在筆者的傳感器網(wǎng)絡節(jié)點中（見圖2），外部設備芯片采用w99200f，它包含100多個寄存器。在芯片上電復位后，芯片寄存器的復位初始值在手冊中是已知的。根據(jù)訪問方式，它包含三類寄存器：只讀、只寫、可讀寫。w99200f芯片部分寄存器偏移地址及其復位初始化值如表1所示。表1 w99200f芯片中部分寄存器及其初始化值寄存器名偏移地址訪問方式數(shù)據(jù)寬度復位值vint_source0x0d只讀80x40vbv_initial0x18讀寫80x13vquality0x19讀寫80x08vin_cntl0x21讀寫80x0cvsize_h0x24讀寫80x2c修改啟動代碼和
cd攝像頭采集到的模擬視頻信號到數(shù)字視頻信號的轉換，主要采用philips公司的saa7113芯片。saa7113是功能強大的可編程視頻輸入處理芯片，可以同時接入4路視頻信號，使用i2c總線技術。 （2）音頻編解碼部分 主要實現(xiàn)從麥克風進入的音頻信號的編解碼，采用philips公司的uda1344。它將a/d和d/a轉換功能集于一身，可以對麥克風輸入的模擬聲音信號進行a/d轉換，形成串行數(shù)字音頻流。 （3）音頻視頻磁場強度處理部分 將輸入的復合音頻、視頻流進行壓縮處理，核心芯片選用臺灣華邦電子的w99200f。該芯片具有強大的內(nèi)部功能，且有多種工作模式可供選擇可供選擇，可與音頻編解碼及視頻解碼芯片實現(xiàn)無縫連接。 （4）邏輯門控制部分 運用fpga進行邏輯與時序控制，采用xilinx公司spartan-iie系列的xc2s50e邏輯控制芯片。片內(nèi)集成了多種系統(tǒng)功能，如數(shù)字延遲鎖相環(huán)（dll）、fifo存儲器、變換器以及總線接口（pci）等，可并行實現(xiàn)多種算法。 （5）嵌入式數(shù)據(jù)處理部分 以at91m40800為嵌入式核心芯片，主要進行系統(tǒng)控制與數(shù)據(jù)處理。 （6）網(wǎng)絡連接部分 通過以太網(wǎng)控制芯片，將音頻
510將數(shù)字視頻數(shù)據(jù)轉化為符合mpeg-1格式的影視文件，最后將mpeg-1數(shù)據(jù)流在arm處理器的控制下通過ide接口以文件形式寫入電子硬盤進行存儲。系統(tǒng)工作時，arm還將不斷監(jiān)視相關信號，并在圖像中加入相應的標志，直到接收到關機信號，系統(tǒng)自動結束壓縮工作。 2 硬件電路設計 2.1 視頻解碼及壓縮編碼電路設計 由于mpeg-1壓縮算法需要很大的運算量，用軟件很難實時完成，所以本系統(tǒng)采用專用的視頻壓縮芯片來實現(xiàn)對視頻信號的實時高效壓縮。目前，常用的mpeg-1壓縮芯片有vw2010、w99200f、wis 7007sb等。本設計選用saa7113h進行解碼，并采用zapex公司的sz1510mpeg-1 a／v編碼芯片進行圖象壓縮。saa7113的主要作用是把輸入的模擬視頻信號解碼成標準的8位“vpo”數(shù)字信號，它相當于一種“a／d”器件，是一種可編程視頻處理芯片，可通過i2c總線實現(xiàn)編程控制，并具有4路視頻輸入、抗混疊濾波、自動鉗位和增益控制、多制式解碼以及亮度、對比度和飽和度控制等功能。它對輸人的pal制式視頻信號進行采樣和解碼后，可將生成的ccir-601數(shù)字視頻流（色度空間為yc
r數(shù)字視頻信號，傳入sz1510音視頻壓縮采集芯片進行處理，將數(shù)字音視頻數(shù)據(jù)轉化為符合mpeg-1格式的混合影視文件，最后mpeg1數(shù)據(jù)流在arm處理器的控制下通過ide接口寫入硬盤或cf卡。在工作時，arm還將不斷監(jiān)視相關信號，并在圖像中加入相應的標志，直到接收到關機信號，系統(tǒng)自動結束壓縮工作。 2 硬件電路設計 由于mpeg-1壓縮算法需要很大的運算量，用軟件實時完成比較困難，所以在本系統(tǒng)中主要依靠專用芯片實現(xiàn)對視頻信號的高效壓縮。目前，常用的mpeg-1壓縮芯片有vw2010、w99200f、wis 7007sb等。本設計采用的是zapex公司的sz1510 mpeg-1 a/v編碼芯片，自身完成音視頻的同步編碼，16位host接口易于與多種微處理器連接。另外，該芯片還可以直接控制視頻解碼芯片saa7113h、音頻解碼芯片ak4550vt和sdram（km416s1020ct-g10）。cpu采用philips公司的arm7tdmis內(nèi)核微控制器lpc2214，通過其i/o端口控制ide接口硬盤或cf卡的數(shù)據(jù)讀取和存儲。 圖1 數(shù)字視頻記錄系統(tǒng)結構框圖 2.1 mpeg-1壓
r數(shù)字視頻信號，傳入sz1510音視頻壓縮采集芯片進行處理，將數(shù)字音視頻數(shù)據(jù)轉化為符合mpeg-1格式的混合影視文件，最后mpeg1數(shù)據(jù)流在arm處理器的控制下通過ide接口寫入硬盤或cf卡。在工作時，arm還將不斷監(jiān)視相關信號，并在圖像中加入相應的標志，直到接收到關機信號，系統(tǒng)自動結束壓縮工作。 2 硬件電路設計 由于mpeg-1壓縮算法需要很大的運算量，用軟件實時完成比較困難，所以在本系統(tǒng)中主要依靠專用芯片實現(xiàn)對視頻信號的高效壓縮。目前，常用的mpeg-1壓縮芯片有vw2010、w99200f、wis 7007sb等。本設計采用的是zapex公司的sz1510 mpeg-1 a/v編碼芯片，自身完成音視頻的同步編碼，16位host接口易于與多種微處理器連接。另外，該芯片還可以直接控制視頻解碼芯片saa7113h、音頻解碼芯片ak4550vt和sdram（km416s1020ct-g10）。cpu采用philips公司的arm7tdmis內(nèi)核微控制器lpc2214，通過其i/o端口控制ide接口硬盤或cf卡的數(shù)據(jù)讀取和存儲。 圖1 數(shù)字視頻記錄系統(tǒng)結構框圖 2.1 mpeg-1壓
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