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數(shù)字分頻器(SN7490、SN7442、SN74150)

如圖所示為數(shù)字分頻電路。該電路由3塊集成電路構(gòu)成，分頻系數(shù)可以從1～9變化。計(jì)數(shù)器SN7490輸出的二-十進(jìn)制數(shù)送至譯碼器SN7442，譯碼器輸出為十進(jìn)制數(shù)。分...

基于SN7490設(shè)計(jì)65~240Hz單音電路
計(jì)數(shù)器sn7490輸出的二-十進(jìn)制數(shù)，數(shù)據(jù)選擇器的輸出反饋到sn7490的復(fù)位輸入端，即每次計(jì)數(shù)周期結(jié)束時(shí)輸出一個(gè)脈沖，該脈沖同時(shí)使計(jì)數(shù)器sn7490復(fù)位。輸出脈沖寬度為60ns，它由電路的傳輸延遲時(shí)間決定。用這種非頻器級(jí)聯(lián)，可以構(gòu)成更大分頻系數(shù)的分頻器。 65~240hz晶體振蕩器的輸出在三只sn7490中分頻1000倍，得到65~240hz單音，饋給業(yè)余fm轉(zhuǎn)播機(jī)。挑選晶體以給出確切的設(shè)計(jì)頻率。q1和q2是mps6513，q3是2n1613。電池源可以是來自收發(fā)機(jī)的9~15v直流或9v電池。來源:陰雨
數(shù)字分頻器(SN7490、SN7442、SN74150)
如圖所示為數(shù)字分頻電路。該電路由3塊集成電路構(gòu)成，分頻系數(shù)可以從1～9變化。計(jì)數(shù)器sn7490輸出的二-十進(jìn)制數(shù)送至譯碼器sn7442，譯碼器輸出為十進(jìn)制數(shù)。分頻系數(shù)由數(shù)據(jù)選擇器sn74150確定。數(shù)據(jù)選擇器的輸出反饋到sn7490的復(fù)位輸入端，即每次計(jì)數(shù)周期結(jié)束時(shí)輸出一個(gè)脈沖，該脈沖同時(shí)使計(jì)數(shù)器sn7490復(fù)位。輸出脈沖寬度為60ns，它由電路的傳輸延遲時(shí)間決定。用這種非頻器級(jí)聯(lián)，可以構(gòu)成更大分頻系數(shù)的分頻器。來源:university
由TTL十進(jìn)制計(jì)數(shù)器構(gòu)成的分頻器
如圖所示為由ttl十進(jìn)制計(jì)數(shù)器構(gòu)成的分頻電路。在許多情況下。需要對(duì)脈沖序列進(jìn)行n(n為整數(shù))分頻。例如，數(shù)字鐘需要進(jìn)行60分頻，得到重復(fù)頻率為1hz的脈沖輸出；又如，時(shí)標(biāo)發(fā)生器需對(duì)晶體振蕩器的輸出頻率進(jìn)行分頻。如果分頻系數(shù)n≤10，則只需用一塊ttl二-十進(jìn)制計(jì)數(shù)器sn7490即可實(shí)現(xiàn)。通常的ttl電路中的分頻是用二進(jìn)制計(jì)數(shù)器，使每n個(gè)輸入脈沖輸出一個(gè)脈沖。當(dāng)?shù)趎個(gè)脈沖輸入時(shí)，計(jì)數(shù)器復(fù)位，計(jì)數(shù)器的最高有效位作為輸出。因此每n個(gè)輸入脈沖計(jì)數(shù)器輸出只能有一種狀態(tài)的變化(即高電平變到低電平或低電平變到高電平)。如果要求輸出是一個(gè)脈沖，則必須再加一級(jí)單穩(wěn)態(tài)多諧振蕩器。利用一個(gè)十進(jìn)制計(jì)數(shù)器sn7490做成的分頻器，分頻系數(shù)可以是2～10之間的任何整數(shù)，主要根據(jù)復(fù)位輸入端(2腳和3腳)與哪個(gè)輸出端相連接來確定。如圖所示連接方法是7分頻。來源:university
數(shù)模轉(zhuǎn)換器
利用帶有d/a轉(zhuǎn)換器sn7490的7407進(jìn)制緩沖器允許在合理寬度的溫度范圍內(nèi)有一個(gè)令人滿意的表現(xiàn)，即使是在驅(qū)動(dòng)幾個(gè)ttl階段的時(shí)候。在邏輯0時(shí)，運(yùn)算放大器741的同相輸入與未使用的緩沖器輸出相連接。來源:zhenglili
簡單的數(shù)模轉(zhuǎn)換器電路
晶體管通過時(shí)鐘控制sn7490 bcd計(jì)數(shù)器的輸出被飽和或者關(guān)閉。通過741總運(yùn)放器，四個(gè)晶體管的發(fā)射電壓部分以1:2:4:8的比例被添加，從而來獲得模擬輸出。文章講述了兩個(gè)這樣的電路如何在兩位dvm中結(jié)合使用。來源:zhengyuan

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