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簡易USB與LVDS接口轉(zhuǎn)換器
便可實現(xiàn)雙視頻顯示的連接，進(jìn)一步擴展兩種接口的使用范圍，從而在一定程度上解決主板插槽與端口日益匱乏的問題。 2 系統(tǒng)概述該系統(tǒng)設(shè)計主要由穩(wěn)壓電路，usb接口，基于fpga的協(xié)議數(shù)據(jù)轉(zhuǎn)換以及l(fā)vds接口等部分組成，其系統(tǒng)設(shè)計框圖如圖1所示。該系統(tǒng)設(shè)計的usb接口使用高速usb物理層收發(fā)器usb3300將usb協(xié)議的差分信號轉(zhuǎn)換成8位的并行信號后，再與fpga交互數(shù)據(jù)，從而避免fpga直接與usb協(xié)議的物理層交互數(shù)據(jù)，簡化fpga可編程門陣列編程?；谕瑯铀枷耄到y(tǒng)lvds接口部分采用sn65lv1023與sn62lv1224，將低壓差分信號轉(zhuǎn)換成 10位的并行信號再與fpga進(jìn)行數(shù)據(jù)交互。通過專用轉(zhuǎn)換器usb3300，sn65lv1023，sn65lv1224使得fpga只與并行信號和相應(yīng)的控制信號連接，而不與usb協(xié)議和lvds協(xié)議的復(fù)雜物理層信號交互，從而較為簡單地實現(xiàn)協(xié)議數(shù)據(jù)轉(zhuǎn)換的軟件編程。系統(tǒng)設(shè)計使用兩片usb3300，其中usb3300 a與主機pc的usb接口相連，將主機傳輸?shù)膗sb協(xié)議數(shù)據(jù)轉(zhuǎn)換后，通過與fpga的數(shù)據(jù)交互以及fpga的協(xié)議數(shù)據(jù)轉(zhuǎn)換，轉(zhuǎn)換成10位并行信號
FPGA處理器在數(shù)字光端機系統(tǒng)中的應(yīng)用
引腳1（db13）：最高輸入有效數(shù)據(jù)位；引腳2~13（db12~db1）：數(shù)據(jù)輸入端；引腳14（db0）：最低輸入有效。 4 并串/串并模塊低壓差分信號是由ansi/tia/eia-644-1995定義的用于高速數(shù)據(jù)傳輸?shù)奈锢韺咏涌跇?biāo)準(zhǔn)（lvds）。它具有超高速（速率可達(dá)1.4gb/s）、超低功耗和低電磁輻射等特性，因而是在銅介質(zhì)上實現(xiàn)千兆位速率通信的優(yōu)選方案。而總線形低壓差分信號lvds是lvds技術(shù)在多點通信領(lǐng)域的擴展，它要求有更大的驅(qū)動電流（10ma）和更好的阻抗匹配設(shè)計。 sn65lv1023和sn65lv1224是ti公司推出的10位總線型低壓差分信號的應(yīng)用芯片組。其中sn65lv1023是可將10位并行cmos或ttl數(shù)據(jù)轉(zhuǎn)換為具有內(nèi)嵌時鐘的高速串行差分?jǐn)?shù)據(jù)流的串化器；而sn65lv1224則是接收該差分?jǐn)?shù)據(jù)流并將它們轉(zhuǎn)換為并行數(shù)據(jù)的解串器，它同時又可以重建并行時鐘。采用該器件組進(jìn)行數(shù)據(jù)串化時采用的是內(nèi)嵌時鐘，這樣可有效地解決由于時鐘與數(shù)據(jù)的不嚴(yán)格同步而制約高速傳輸?shù)钠款i問題。此處的硬件電路設(shè)計如圖4所示。圖4 并串轉(zhuǎn)化硬件示意圖系統(tǒng)軟件設(shè)計系統(tǒng)軟件主要是對系統(tǒng)控制

SN65LV1023ADB的技術(shù)參數(shù)
產(chǎn)品型號:SN65LV1023ADB
并行輸出數(shù):－
并行輸入數(shù):10
數(shù)據(jù)吞吐量(Mbps):660
串行數(shù)據(jù)接收通道:－
串行數(shù)據(jù)發(fā)送通道:－
線路類型:LVDS
驅(qū)動(RL)(Ω):27
工作電壓(V):3.300
接收tpd(ns):－
工作電流ICC(mA):55
P...

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SN65LV1023ADB的技術(shù)參數(shù)

sn65lv1023替代型號

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