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通過先進(jìn)的高性能UART提高串行I/O的連接性能
選擇如spi或i2c的標(biāo)準(zhǔn)串行總線與主機(jī)相連。當(dāng)今流行的解決方案是nxp sc16is7xx系列，這些產(chǎn)品通過i2c或spi端口實(shí)現(xiàn)與主機(jī)的無縫連接，并將與主機(jī)連接的15根線減少到5根(i2c)和7根(spi)，如圖2所示。這個串行uart還有其它一些優(yōu)點(diǎn)，例如它能為設(shè)計(jì)工程師提供現(xiàn)成的i2c或spi到rs232/rs485/irda的協(xié)議轉(zhuǎn)換器，但缺點(diǎn)是串行總線的速度被限制在400 kbps(i2c)和15 mbps (spi)內(nèi)。圖2：帶有串行接口(i2c/spi)的nxp sc16is752高速uart的應(yīng)用示例。一旦選定了主機(jī)接口，最佳的主機(jī)處理時間取決于以下幾個要素：uart的 fifo深度和fifo計(jì)數(shù)器、中斷觸發(fā)等級的數(shù)量、硬件和軟件流程控制。 fifo深度和fifo計(jì)數(shù)器 uart的 fifo深度直接影響通過uart傳輸數(shù)據(jù)所需的cpu開銷。fifo的深度越深，在每個中斷就可以有更多數(shù)據(jù)傳輸，從而減少cpu的中斷。一個標(biāo)準(zhǔn)的fifo深度范圍從16 到 6? 字節(jié)。但越來越多的設(shè)計(jì)要求具有更深fifo的uart，而可提供具有高達(dá)128字節(jié)fifo深度的獨(dú)

SC16IS752的問題
sc16is752的問題在使用philips這款芯片的時候，我使能了接收發(fā)送fifo，觸發(fā)深度皆為16字節(jié)。使能芯片的接收中斷功能時候（spi0_write(ier,0x01)），程序能正常接收數(shù)據(jù)，也能發(fā)送數(shù)據(jù)。一旦同時也使能了sc16is752的發(fā)送中斷（spi0_write(ier,0x03)），程序運(yùn)行就不太正常，就不能正確接收數(shù)據(jù)了,好像是sc16is752就不能產(chǎn)生中斷信號了。不知道是何故，有沒有人碰到同樣的情況？
那位兄臺用過max3100 c51的驅(qū)動有嗎，發(fā)我一個
sc16is752多好的東西！
請教：關(guān)于SC16IS752的內(nèi)部寄存器配置問題
請教：關(guān)于sc16is752的內(nèi)部寄存器配置問題看了文檔，使用i2c進(jìn)行配置，不太確定子地址應(yīng)該是多少？比如配置線控制寄存器(lcr)，文檔中它的地址是0x03,在子地址中應(yīng)該是3~6位配置的為通道0,那么地址是不是應(yīng)該為0x18,請周立功的工程師或用過的高手解釋一下??？謝謝。
有關(guān)philips的uart芯片的問題
最近我們有人在做sc16is752的 demo board。還沒有遇見您說的這種情況.
SPI擴(kuò)2個UART,飛利浦有這樣的IC嗎?
resc16is752 :here ,the chip you need. * - 本貼最后修改時間：2006-8-31 11:05:19 修改者：foyyof sc16is752

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