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系統(tǒng)將更能發(fā)揮出自身的優(yōu)勢。本系統(tǒng)中的外圍電路設(shè)計相對簡單、可靠，且鑒于fpga和vhdl語言自身的特點，系統(tǒng)具有較好的擴展性，在監(jiān)測和控制系統(tǒng)中也具有一定的通用性。系統(tǒng)主要包括：fpga芯片區(qū)、多路選擇與a/d采樣電路、交流信號調(diào)理電路、光耦隔離驅(qū)動電路、時鐘電源區(qū)、prom代碼下載電路等幾部分。結(jié)構(gòu)示意如圖1所示。圖1 基于fpga技術(shù)的多路模擬量、數(shù)字量采集與處理系統(tǒng)框圖1 fpga芯片特點分析及資源分配本系統(tǒng)中的fpga是采用xilinx公司的spantan-ii系理xc2s100-5 pq208。該系列的內(nèi)核采用2.5v供電，工作頻率最高可達200 mhz；i/o端口供電電壓為3.3v，可以承受5v的輸入高電平。spartan-ii系列具有豐富的i/o口資源，i/o口輸出緩沖器呆以接收高達24ma的拉電流和48ma的灌電流。缺省時，i/o輸出口的驅(qū)動能力的12ma，也可以設(shè)置成2、4、6、8、16或24ma。fpga內(nèi)部資源劃分為四大部分，如圖2所示。①fpga邏輯運算中心。用來接收其它各部分的數(shù)據(jù)，并按照程序中設(shè)定的方案對所收到的數(shù)據(jù)進行相應(yīng)的分析和處理。包括：對從mcu接收來的數(shù)據(jù)
actel公司為其以反熔絲為基礎(chǔ)的高性能axcelerator現(xiàn)場可編程門陣列 (fpga)器件，推出靈活的低成本啟動工具套裝。axcelerator啟動套裝備有基本評估和先進建模兩種版本，內(nèi)容包括帶有actel ax250-pq208 axcelerator器件的評估板、libero gold集成設(shè)計環(huán)境 (ide)、使用指南以及支持文檔。 先進的建模版本還包括一個編程插口模塊適配器，以及該公司silicon sculptor ii編程器的6個月租用計劃證書。利用先進的建模版本，用戶可以瀏覽整個設(shè)計流程，從hdl到編程，同時還可獲得axcelerator器件的固有優(yōu)勢，包括針對各式應(yīng)用提供高性能、低功耗和高安全性。此外，啟動套裝的用戶可以提交定制的axcelerator設(shè)計，以及在24小時內(nèi)通過線上建模服務(wù) (ops) 得到免費的編程樣品 (在北美洲地區(qū))。 axcelerator啟動套裝的評估板配有pq208插口，提供額外的靈活性，讓設(shè)計人員于毋須更換評估板的情況下，在ax250-pq208及較大的ax500-pq208器件之間互換。該評估板還提供一個建模區(qū)
的出色解決方案?！?據(jù)稱，這款一百萬系統(tǒng)門proasic3 a3p1000提供業(yè)界最低的待機電流消耗，在一般狀態(tài)下待機電流為8ma，較同類型競爭產(chǎn)品低近一個量級。此外，proasic3器件包含1024位(128位×8頁)片上用戶非揮發(fā)性flash內(nèi)存，并內(nèi)置鎖相環(huán)(pll)電路。該器件還通過片上128位aes加密技術(shù)和內(nèi)置flash密鑰儲存技術(shù)提供安全的系統(tǒng)內(nèi)編程(isp)功能。 a3p1000和配備arm7的m7a3p1000均采用fg144、 fg256、fg484和pq208封裝供貨，現(xiàn)已備有樣本。 來源:小草
片，減少了所需控制端口數(shù)量；采用具有大量控制端口的現(xiàn)場可編程門陣列(field programmable gate array，fpga)作為系統(tǒng)的控制芯片，在使用veriloghdl語言對其編程后，可同時對30個pcr芯片實施控制。 2 硬件設(shè)計 系統(tǒng)以fpga芯片為控制核心，實現(xiàn)對信號調(diào)理模塊、a／d模塊、高壓模塊、溫度控制模塊以及usb傳輸模塊的控制。具體結(jié)構(gòu)示意圖如圖1所示。虛線框內(nèi)為相應(yīng)的控制信號。 fpga采用xilinx公司的spartan ii 2s100-pq208-5。pq208表示其封裝為208引腳，“5”表示時延為5 ns。該器件密度為1o萬門，內(nèi)置5 kb的ram，最高工作頻率可達到125 mhz，用戶可編程使用的i／o端口數(shù)目多達196個。工作核心電壓引腳接+2．5 v電源，其輸入／輸出(i／o)引腳支持ttl、lvttl電平邏輯，需接+3．3 v電源。程序存儲采用cpld加flash的方式。spartan ii系列的fpga支持4種配置模式：從串行模式、主串行模式、從并行模式和邊界掃描模式。在調(diào)試時期，采用邊界掃描模式。在程序編制成功后，使用通
的傳輸。 (6) 一旦frame#有效，地址期開始有效，ad[31：0]傳輸一個有效地址，c／be[3：0]#線上傳輸總線命令。 (7) 第二個時鐘里，ad[31：0]開始傳送數(shù)據(jù)，c／be[3：0]#上的信息是提出資料線上哪些字節(jié)是有效的，從數(shù)據(jù)的開始一直到傳輸?shù)耐瓿?，c／be#始終保持有效狀態(tài)。 2 主板診斷卡設(shè)計 本設(shè)計利用一塊pld對pcl局部總線進行控制并提取數(shù)據(jù)達到最終解譯。pld專用接口芯片選擇xilinx公司xc9500系列cpld中xc952288xl pq208零件。該零件采用系統(tǒng)內(nèi)編程——isp技術(shù)，支持擴充的ieee1149.1邊界掃描標準，著重滿足系統(tǒng)內(nèi)編程的要求，增強的引腳鎖定能力可以避免重做昂貴的印制板，擴充的jtag指令集允許編程模式和系統(tǒng)內(nèi)診斷的各種控制。器件編程僅用一根下載電纜通過下載軟件和器件的編程接口相連即可實現(xiàn)，提供10 000次以上編程／擦除周期，宏單元數(shù)有288個。 本設(shè)計主要由以下3部分組成：數(shù)據(jù)接口(金手指)部分、pld部分和顯示(led燈)部分。 2.1 數(shù)據(jù)接口(金手指)部分 該部分的主要作用是通過pci插槽將d
統(tǒng)設(shè)計方法。對fpga器件進行開發(fā)可以有2種eda工具選擇。一是采用專用半導(dǎo)體廠家的工具，這種方式可以提供高效的設(shè)計和綜合能力，可支持專用芯片，但設(shè)計的可移植性不好。二是采用標準eda設(shè)計平臺，盡管設(shè)計可能對芯片內(nèi)部資源利用率不高，但在不同asic(專用集成電路)間有可移植性。筆者利用fpga器件和eda工具，研制了以fpga器件和80c196kc微處理器為核心的8k機車輔助電源變流器控制板(rd753、rd754)自動測試系統(tǒng)。該裝置選用xilinx公司第3代現(xiàn)場可編程邏輯芯片xc4010e-pq208，采用viewlogic公司workviewoffice eda工具進行fpga的前端設(shè)計開發(fā)，用xilinx公司foundation series m1.4.12 eda工具進行fpga的布局布線和物理實現(xiàn)。整個fpga的設(shè)計開發(fā)流程如圖2所示。該裝置可檢測rd753，rd754板的各項電氣參數(shù)，并以良好的人機界面進行波形和參數(shù)的顯示、存儲、打印輸出。 圖1 新型數(shù)字系統(tǒng)設(shè)計方法 圖2 fpga 設(shè)計流程 2 xc4010e—pq208內(nèi)部結(jié)構(gòu)及其特點 xc4010e—pq
成本效益的出色解決方案?！?這款一百萬系統(tǒng)門proasic3 a3p1000提供業(yè)界最低的待機電流消耗，在一般狀態(tài)下待機電流僅為8ma，較同類型競爭產(chǎn)品低近一個量級。此外，proasic3器件包含1024位(128 位x8頁)片上用戶非揮發(fā)性flash內(nèi)存，并內(nèi)置鎖相環(huán)(pll)電路。該器件還通過片上128位aes加密技術(shù)和內(nèi)置flash密鑰儲存技術(shù)提供安全的系統(tǒng)內(nèi)編程(isp)功能。 價格與供貨 a3p1000和配備arm7的m7a3p1000均采用fg144、 fg256、fg484和pq208封裝供貨。a3p1000和m7a3p1000現(xiàn)已備有樣本。
3p1000是具成本效益的出色解決方案?！?據(jù)稱，這款一百萬系統(tǒng)門proasic3 a3p1000提供業(yè)界最低的待機電流消耗，在一般狀態(tài)下待機電流為8ma，較同類型競爭產(chǎn)品低近一個量級。此外，proasic3器件包含1024位(128位×8頁)片上用戶非揮發(fā)性flash內(nèi)存，并內(nèi)置鎖相環(huán)(pll)電路。該器件還通過片上128位aes加密技術(shù)和內(nèi)置flash密鑰儲存技術(shù)提供安全的系統(tǒng)內(nèi)編程(isp)功能。 a3p1000和配備arm7的m7a3p1000均采用fg144、 fg256、fg484和pq208封裝供貨，現(xiàn)已備有樣本。
求教關(guān)于xilinx芯片兩個封裝的區(qū)別f-qfp28x28-g208/y1.55n 和 f-qfp28x28-g208/p.5n 兩個封裝都是pq208的封裝,最后的y1.55n和p.5n代表什么意思,區(qū)別在什么地方???感激!
問一個用fpga壓縮jpg圖片的問題定型階段，請大家多多指導(dǎo)?。?！不知道有人做過沒有，我們需要把1600x1200的位圖壓縮為jpg圖片，不知道大約要用多少資源，如果采用一片pq208封裝的xc3s400，連接一個8m byte的sdram，能做得下嗎？
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