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  • 基于片上系統(tǒng)的NO.7信令采集終端的設(shè)計(jì)

    1 的交叉連接及時(shí)隙交換。具體而言，若16 個(gè)e1 全部為 接收，則實(shí)現(xiàn)4 個(gè)8m（512 時(shí)隙，輸入）到2 個(gè)hdlc（scc2、scc3 共64 個(gè)時(shí)隙的交換， 輸出），具體操作由cpu 的控制來(lái)實(shí)現(xiàn)，然后送入fpga 內(nèi)嵌mpc860 的hdlc scc2、 scc3 進(jìn)行信令處理，處理完畢后，由mpc860 的100m 以太網(wǎng)scc1 送到系統(tǒng)服務(wù)器。 3.1.2 邏輯部分 fpga 中還需要實(shí)現(xiàn)以下的兩個(gè)外圍模塊： 復(fù)位模塊：系統(tǒng)硬復(fù)位、各個(gè)器件（4 片pm4354、1 片mt9042、1 片lxt971 的軟復(fù)位）； 復(fù)位部分的設(shè)計(jì)，可以對(duì)所有的芯片完成硬復(fù)位，也可以根據(jù)要求，對(duì)某一個(gè)器件來(lái)完成軟 復(fù)位； 地址譯碼模塊：完成4 片pm4354 地址譯碼以及片選部分的譯碼電路設(shè)計(jì) 3.2 fpga 片上cpu860 軟件設(shè)計(jì) 3.2.1 運(yùn)行過(guò)程 采集終端軟件固化在flash 上，終端上電后，首先運(yùn)行初始引導(dǎo)程序，完成板級(jí)的初始 化工作，然后將操作系統(tǒng)裝入內(nèi)存并執(zhí)行，操作系統(tǒng)最后將應(yīng)用程序裝入內(nèi)存并啟動(dòng)。應(yīng)用 程序即是上面介紹的四大模塊

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