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如何降低便攜式設備的待機功耗
式設備電源管理設計在內核電壓、能耗管理和電池壽命等方面所面臨的挑戰(zhàn)。處理器內核在全功率模式下的功耗與工作頻率和vcore2成比例。根據處理器的工作頻率，內核電壓可被動態(tài)和精確地調節(jié)到較低限值，從而達到降低功耗的目的。在待機模式下，由于微處理器或dsp的內核通常呈阻抗特性，因此電源管理沒有在全功率模式下那么復雜。電壓主要用于維持存儲器和寄存器的狀態(tài)。由于較新的內核設計都采用較低的電壓，因此消耗的電流也較少，可以顯著改善待機時的功耗。本文將介紹如何利用非常簡單的電壓調節(jié)技術以及micrel公司mic2214芯片上的ttl兼容邏輯輸入來有效地降低待機時的功耗。用于蜂窩電話和pda基帶及dsp的雙ldo mic2214是一個帶有開漏驅動器和上電復位電路的雙 μcap低壓降線性調節(jié)器。第一個穩(wěn)壓器可以提供150ma的電流，第二個穩(wěn)壓器最多可以提供300ma電流，并包含上電復位功能。mic2214的地電流非常低，每個ldo只有24μa。mic2214有一個兼容ttl邏輯的使能引腳，可使芯片進入零關斷模式電流狀態(tài)，因此在不工作時幾乎不消耗電流。固定電壓輸出的mic2214采用3 x 3 mlf 封裝，而可

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