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基于FPGA的高速數(shù)字隔離型串行ADC及其工程應(yīng)用
跟蹤電壓波形，根據(jù)特定的跟蹤控制算法產(chǎn)生相應(yīng)的spwm控制信號驅(qū)動半橋主電路。假設(shè)逆變單元的開關(guān)頻率為10khz,最小占空比為10％，按照香農(nóng)定理adc采樣頻率至少為200khz,在工程應(yīng)用中一般留有7～10倍余量，所以高速adc的采樣頻率應(yīng)該在1mhz左右。max1072為10位單極型串行adc，可以實現(xiàn)1.8mhz采樣頻率?？梢妋ax1072在采樣頻率和輸出精度方面均滿足跟蹤控制的要求。同時，采用串行adc控制引腳少，占用控制器i／o端口少，所需隔離芯片少，電路結(jié)構(gòu)簡單可靠性高。隔離芯片采用iso721d，其傳輸帶寬可達(dá)150mhz。 2.2 高速數(shù)字隔離型adc實現(xiàn)原理本論文主要研究高速隔離型adc的實現(xiàn)方案，即圖(1)中虛線框內(nèi)的部分。此部分原理示意圖如圖(2)所示。圖中由fpga產(chǎn)生兩路輸出信號分別為clk1和sta1。clk1經(jīng)過隔離芯片輸出信號clk作為串行adcmax1072的時鐘信號其頻率為24mhz。sta1經(jīng)過隔離芯片輸出信號sta作為adc的啟動控制信號其頻率為1.5mhz。adc的轉(zhuǎn)換結(jié)果為data信號，經(jīng)隔離芯片輸出data1信號送回fpga。
高速數(shù)字隔離型串行ADC及其工程應(yīng)用
跟蹤電壓波形，根據(jù)特定的跟蹤控制算法產(chǎn)生相應(yīng)的spwm控制信號驅(qū)動半橋主電路。假設(shè)逆變單元的開關(guān)頻率為10khz,最小占空比為10％，按照香農(nóng)定理adc采樣頻率至少為200khz,在工程應(yīng)用中一般留有7～10倍余量，所以高速adc的采樣頻率應(yīng)該在1mhz左右。max1072為10位單極型串行adc，可以實現(xiàn)1.8mhz采樣頻率。可見max1072在采樣頻率和輸出精度方面均滿足跟蹤控制的要求。同時，采用串行adc控制引腳少，占用控制器i／o端口少，所需隔離芯片少，電路結(jié)構(gòu)簡單可靠性高。隔離芯片采用iso721d，其傳輸帶寬可達(dá)150mhz。 2.2 高速數(shù)字隔離型adc實現(xiàn)原理本論文主要研究高速隔離型adc的實現(xiàn)方案，即圖(1)中虛線框內(nèi)的部分。此部分原理示意圖如圖(2)所示。圖中由fpga產(chǎn)生兩路輸出信號分別為clk1和sta1。clk1經(jīng)過隔離芯片輸出信號clk作為串行adcmax1072的時鐘信號其頻率為24mhz。sta1經(jīng)過隔離芯片輸出信號sta作為adc的啟動控制信號其頻率為1.5mhz。adc的轉(zhuǎn)換結(jié)果為data信號，經(jīng)隔離芯片輸出data1信號送回fpga。

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