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短波軟件無線電通信系統(tǒng)中的DSP技術(shù)
中頻數(shù)字化軟件無線電結(jié)構(gòu)的實用短波軟件無線電接收機中的數(shù)字信號處理技術(shù)。1 短波軟件無線電接收機的硬件組成短波軟件無線電接收機的硬件組成如圖1所示。圖中射頻轉(zhuǎn)換模塊（rf）包括2個混頻器和相應(yīng)的模擬濾波器，以產(chǎn)生合適的中頻寬帶信號；模／數(shù)轉(zhuǎn)換部分，采用了二中頻并行a／d轉(zhuǎn)換方案，所選芯片為ad9240；數(shù)字信號處理模塊中的數(shù)字下變頻部分，其完成的功能主要有：下變頻、濾除帶外噪聲、降低采樣率等。主要指標有動態(tài)范圍、抽取濾波器的性能、頻率分辨率和輸出信號的精度等。所選芯片為harris公司生產(chǎn)的hsp50016；數(shù)字信號處理模塊中的數(shù)字信號處理部分，主要完成信息解調(diào)、控制射頻前端和接收面板cpu的控制信號等任務(wù)。我們要求該部分的微處理器芯片速度快、精度高及具有較多便捷的信息傳輸通路和通信端口。所選芯片為ti公司生產(chǎn)的tms320c31。信號接收過程為：天線接收到的高頻信號(15 khz~30 mhz)以后，與可調(diào)本地振蕩器(lo1頻率為：62.5~92.5 mhz)相混頻，得到期望的第一中頻信號(62.5 mhz)，再與本地固定振蕩器(lo2頻率為：62.5 mhz) 混頻產(chǎn)生第二中頻信號(2.5
基于新型FPGA實現(xiàn)高速數(shù)字下變頻
轉(zhuǎn)換到中頻（if）上，在中頻對模擬信號進行數(shù)字化，然后采用數(shù)字下變頻（digital down conversion,ddc）技術(shù)，將采樣率較低的信號送給后續(xù)的基帶信號處理單元。實現(xiàn)ddc主要有三種途徑：（1）采用已有的專用芯片；（2）自己制作專用芯片；（3）基于fpga或dsp等通用芯片自建平臺實現(xiàn)ddc。但是在高采樣速率的系統(tǒng)中，如a/d采樣的速率為400mhz時，這三種方法顯示出各自的弊端：商用專用芯片要求a/d團拜轉(zhuǎn)換出的數(shù)據(jù)速率較快，比如ad6620要求數(shù)據(jù)速率小于70mhz，hsp50016要求數(shù)據(jù)速率小于75mhz；而自己制作專用芯片，由于成本過高和國內(nèi)技術(shù)條件的限制，在小規(guī)模的研發(fā)生產(chǎn)中幾站是不可能的；用dsp芯片自建平臺實現(xiàn)ddc時，雖然dsp可以高速執(zhí)行乘加指令，但由于dsp是串行執(zhí)行指令的，在高速片中會遇到處理能力過低的問題；雖然用fpga片內(nèi)資源可以同時進行多個乘加運算，但是用fpga片內(nèi)資源實現(xiàn)的乘法器速度較慢，很難實現(xiàn)高速數(shù)據(jù)流的實時乘加處理。本文介紹一種基于新型fpga的高速數(shù)字下變頻的實現(xiàn)方法，它充分利用數(shù)字下變頻的優(yōu)化算法以及fpga領(lǐng)域的新技術(shù)，去除

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