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基于DSP和FPGA的機載總線接口板研究
送可以選擇單幀發(fā)送或自動重復(fù)發(fā)送（重復(fù)發(fā)送某一幀）。整個接口板由調(diào)制電路、解調(diào)電路、fpga、dsp和雙口ram組成，如圖2所示。圖2 接口板硬件結(jié)構(gòu)圖 3 硬件電路設(shè)計 3.1 調(diào)制解調(diào)電路設(shè)計 429信號進入接口板后，首先要把429信號轉(zhuǎn)換為數(shù)字電路可以識別的ttl電平。這里采用holt公司的hi-8482實現(xiàn)信號的解調(diào)，將標準的429總線信號轉(zhuǎn)換成5v ttl數(shù)字信號。為了降低干擾，在429總線信號的四個輸入管腳分別接入39pf的高精度軍品電容；采用holt公司的hi-8585芯片實現(xiàn)信號的調(diào)制，將ttl數(shù)字電平轉(zhuǎn)換為標準的429信號。 3.2 fpga內(nèi)部邏輯設(shè)計按照429信號的編碼格式、特點、傳輸規(guī)則以及協(xié)議要求，選用一片altera公司的acex1k型的fpga發(fā)送和接收四路數(shù)據(jù)。每一路分為接收部分和發(fā)送部分。接收部分的主要作用是通過串/并轉(zhuǎn)換將串行數(shù)據(jù)轉(zhuǎn)換為32位并行數(shù)據(jù)，并對收到的數(shù)據(jù)自動實行差錯控制。對于字間隔、位間隔出錯等錯誤能進行自動檢測，若無錯誤，則將數(shù)據(jù)分兩次送至dsp的16位數(shù)據(jù)總線上，以供讀取。接收模塊結(jié)構(gòu)框圖如圖3所示。
ARINC429總線IP核設(shè)計及應(yīng)用探討
。軟件開發(fā)人員可在測試計算機上完成功能多樣的應(yīng)用程序設(shè)計，接收數(shù)據(jù)通過驅(qū)動程序上傳至應(yīng)用程序，應(yīng)用程序也可將待發(fā)送數(shù)據(jù)通過驅(qū)動程序?qū)懙桨蹇ㄖ校惺瞻l(fā)數(shù)據(jù)均可利用軟件記錄并描述。板卡的硬件設(shè)計框圖如圖5所示。在本應(yīng)用中，將ip核配置成8路接收通道和8路發(fā)送通道，經(jīng)綜合后下載至fpga中，fpga選用altera公司cyclone系列ep1c20，ip核和pci接口模塊綜合后共占用邏輯單元14 300個，占總量的72%，存儲單元55 296個，占總量的75%；arinc429總線驅(qū)動芯片選用hi-8585和hi-8591；pci接口芯片選用pci9054。在測試過程中，將應(yīng)用arinc249總線ip核的pci卡與計算機主板進行連接，對pci卡的全部功能進行驗證，并利用嵌入式邏輯分析儀signal tap捕獲fpga的輸入輸出信號，這里以應(yīng)用程序向ip核寫入發(fā)送數(shù)據(jù)32位“1”為例，如圖6可知，ip核的輸出符合arinc429信號標準，功能配置和狀態(tài)查詢寄存器全部工作正常。基于eda技術(shù)實現(xiàn)的arinc429總線ip核在功能上不僅可完全取代專用芯片，還加入了更符合實際應(yīng)用的單次或循

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