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DVB-C機頂盒信源解碼器的設(shè)計與實現(xiàn)
控振蕩器產(chǎn)生的時鐘信號經(jīng)過74lvc14整形后送到sc2005的vcxo引腳，并通過sdet引腳的輸出進行同步恢復(fù)。傳輸流復(fù)用、音視頻解碼、圖形處理等功能均由sc2005內(nèi)部相應(yīng)的集成模塊配合外部相關(guān)電路來實現(xiàn)。 cpu及存儲控制子系統(tǒng) sc2005集傳輸解復(fù)用器 l641x8和mpeg-2音視頻解碼器l64105的功能于一體，內(nèi)含ez4102內(nèi)核、16kb指令cache和8kb數(shù)據(jù)cache，這是sc2005的核心組成部分。該信源解碼器所用的兩片1m×16bit flash rom均為am29lv160dt-70，使用單一電源供電，讀寫和編程均使用3.3v電壓，高速70ns讀寫時間。它們通過e-bus與sc2005相連，地址總線a[6:0]和sc2005的addr[7:1]相連，a[19:7]和sc2005的ad[28:16]相連，數(shù)據(jù)總線dq[15:0]和sc2005的ad[15:0]相連。芯片內(nèi)部共有35個扇區(qū)，其中4個作為引導(dǎo)扇區(qū)，大小為4k字~16k字，其余31個扇區(qū)為32k字；有一個字節(jié)/字模式選擇引腳byte#，本設(shè)計中該引腳接高電平，選擇字模式。 81mhz/1m×16bit的sdram
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復(fù)。傳輸流復(fù)用、音視頻解碼、圖形處理等功能均由sc2005 內(nèi)部相應(yīng)的集成模塊配合外部相關(guān)電路來實現(xiàn)。 cpu 及存儲控制子系統(tǒng) s c 2 0 0 5 集傳輸解復(fù)用器l641x8 和mpeg-2 音視頻解碼器l64105的功能于一體，內(nèi)含ez4102內(nèi)核、16kb 指令cache 和8kb 數(shù)據(jù)cache，這是sc2005 的核心組成部分。該信源解碼器所用的兩片1m× 1 6 b i t f l a s h r o m 均為am29lv160dt-70，使用單一電源供電，讀寫和編程均使用3.3v電壓，高速70ns 讀寫時間。它們通過ebus與sc2005 相連，地址總線a[6:0]和sc2005 的addr[7:1]相連，a[19:7]和sc2005的ad[28:16]相連，數(shù)據(jù)總線dq[15:0]和sc2005的ad[15:0]相連。芯片內(nèi)部共有35個扇區(qū)，其中4個作為引導(dǎo)扇區(qū)，大小為4k 字~16k 字，其余31個扇區(qū)為32k字；有一個字節(jié)/字模式選擇引byte#，本設(shè)計中該引腳接高電平，選擇字模式。 81mhz/1m × 16bit

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