ADTL2-18
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原裝正品熱賣,價格優(yōu)勢
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長期供應原裝現貨,實單可談
選用了adc10d1000。 為了給adc10d1000提供更穩(wěn)定相噪更好的時鐘信號,該時鐘信號由外部晶振和鎖相環(huán)(lmx2312和vco190-964)產生。vco190-964的頻率范圍為951-977 mhz,單端輸出。由fpga控制lmx2312的工作方式及工作頻率,設計選用200 khz為相位監(jiān)測比較頻率,lmx2312通過比較自身時鐘信號與vco反饋信號產生控制電壓,鎖定vco的輸出頻率為960 mhz。 adc10d1000輸入的時鐘信號要求為差分形式,因此要通過變壓器adtl2-18對vco輸出信號進行轉換,且變壓器輸出端應接100 ω差分阻抗匹配a/d的輸入阻抗。a/d的輸出為lvds信號,所以在與fpga連接時要注意100 ω匹配電阻要靠近fpga管腳。為保證adc10d1000的輸出不減 少數據吞吐率,設計采用內部1:2demux增加數據寬度的方法,即同時并行輸出2組10位采樣數據,及ddr模式在時鐘上升沿和下降沿均輸出數據的方法降低了時鐘速率,使輸出時鐘頻率降為時鐘信號960 mhz的1/4,即240 mhz。 為了在調試時,可以很方便地修改fpga內部