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分析儀hp54645d實測波形如圖1所示(取m=4，n=104)。結(jié)語 通過對fpga進行vhdl編程，實現(xiàn)了將速率為n×64kbps (n=1~124)的hdlc數(shù)據(jù)按比特分接至m路(m=1~4)e1信道中傳輸,并充分利用e1奇幀的ts0時隙,為用戶提供12kbps的同步數(shù)據(jù)傳輸通道,而且允許各路e1有64ms的時延。本文設計的hdlc轉(zhuǎn)e1傳輸控制器也可以作為其它協(xié)議轉(zhuǎn)換器的一個過渡橋梁。例如可以將10base-t的以太網(wǎng)信號，先經(jīng)過以太網(wǎng)轉(zhuǎn)hdlc協(xié)議控制器(如admtek公司生產(chǎn)的adm6993芯片)，然后通過hdlc轉(zhuǎn)e1傳輸控制器，從而實現(xiàn)了ethernet over tdm的功能。 參考文獻:[1]. rs-232 datasheet http://www.udpf.com.cn/datasheet/rs-232_584855.html.[2]. ep1c6 datasheet http://www.udpf.com.cn/datasheet/ep1c6_527325.html.[3]. w24l01 datasheet http://www.udpf.com.cn/datasheet/w24l
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