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具有PCI和并行接口的數(shù)據(jù)采集系統(tǒng)設(shè)計
pga進行存儲。在fpga中設(shè)計了高速緩沖器dcfifo和高速存儲器dpram以及一系列時序控制邏輯，以保證在預(yù)定容量下能夠?qū)崟r的存儲由adc發(fā)送過來的數(shù)據(jù)。同時，在fpga中還設(shè)計了2種數(shù)據(jù)傳輸接口，從而使得系統(tǒng)可以在我們選擇的模式下進行數(shù)據(jù)傳輸，或通過并行接口，或通過pci總線接口。圖1 系統(tǒng)總體框圖 2.2 模擬中頻信號預(yù)處理模塊首先，將該輸入信號通過兩級放大器，目的是為了使模擬輸入信號幅度達到ad6644輸入幅度的要求和對模擬輸入信號進行很好的隔離。這里選用ad9618來實現(xiàn)對模擬信號的放大功能。ad9618的單位增益帶寬和壓擺率的指標均較高，能起到對模擬輸入信號放大和改善性能的作用。電路圖如圖2所示。圖2 兩級ad9618放大器原理圖其次，將經(jīng)過放大處理后的單端信號通過ad8138，轉(zhuǎn)換為差分信號后輸出給ad6644。這么做是因為作為新型的高轉(zhuǎn)換速度、大動態(tài)范圍的adc，為保證其性能，ad6644的模擬輸入信號要求差分形式。在模擬信號階段使用差分形式，可以有效地濾除偶次諧波分量，同時對其它共模雜散信號(如由電源和地引入的噪聲)及對晶振
基于ISA總線的高速同步數(shù)據(jù)采集系統(tǒng)設(shè)計
高速a/d轉(zhuǎn)換 a/d轉(zhuǎn)換采用閃爍adc器件ad9048，其最大轉(zhuǎn)換速率為35msps，分辨率為8位。利用高速雙極工藝制造，采樣速率快，頻帶寬，無代碼遺失，輸入電容小（僅為16pf），功耗低（為500mw）。ad9048內(nèi)部時鐘鎖定比較器可使編碼邏輯電路和輸出緩沖寄存器作在35msps的高速，并避免了多數(shù)系統(tǒng)對取樣保持電路（s/h）和跟蹤保持電路（t/h）的需要。數(shù)字輸入、輸出及控制電平與ttl兼容。ad589和ad741、2n3906等構(gòu)成穩(wěn)壓可調(diào)電路，提供給9048的rb、rt接地。ad9618作為輸入緩沖放大器[3]。由于ad9048的數(shù)據(jù)輸出沒有三態(tài)門控制，故在輸出加上74ls241作三態(tài)門控制。ad9048是否工作取決于輸入轉(zhuǎn)換脈沖信號，在脈沖信號上升沿取樣。轉(zhuǎn)換脈沖來自采樣頻率控制電路中的8254分頻器的輸出。 1.2 高速尋址對于高速數(shù)據(jù)采集系統(tǒng)，a/d轉(zhuǎn)換應(yīng)不受cpu控制。每當adc轉(zhuǎn)換一次后，由控制電路發(fā)出相應(yīng)的信號，將adc轉(zhuǎn)換結(jié)果寫入高速緩存ram某單元中，再使地址計數(shù)器加1，直到地址計數(shù)器記滿后產(chǎn)生采樣結(jié)束信號，封鎖ram寫信號，利用二進制地址發(fā)生

具有跟蹤-保持的中頻(IF)信號采集電路(AD9100/AD9618)
相關(guān)元件pdf下載：ad9100 ad9618 如圖所示為具有跟蹤-保持的中頻(if)信號采集電路。ad9100有著寬的動態(tài)范圍，因此可以用于采集超級信號，直接將中頻信號(if)變換為數(shù)字信號。中頻信號輸入ad9100后，由t／h時鐘控制采樣和保持，輸出后由ad9618放大，再由adc電路將模擬信號轉(zhuǎn)換為數(shù)字信號。用減小模擬信號輸入電平的方法來實現(xiàn)跟蹤和保持，并將失真減小到最??；同時調(diào)節(jié)ad9618增益，使輸入到adc的模擬信號范圍符合a／d變換器全刻度范圍的模擬-數(shù)字轉(zhuǎn)換。

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具有跟蹤-保持的中頻(IF)信號采集電路(AD9100/AD9618)

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