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高速ADC的低抖動時鐘設(shè)計
其性能在很大程度上決定了接收機的整體性能。在a/d轉(zhuǎn)換過程中引入的噪聲來源較多，主要包括熱噪聲、adc電源的紋波、參考電平的紋波、采樣時鐘抖動引起的相位噪聲以及量化錯誤引起的噪聲等。除由量化錯誤引入的噪聲不可避免外，可以采取許多措施以減小到達(dá)adc前的噪聲功率，如采用噪聲性能較好的放大器、合理的電路布局、合理設(shè)計采樣時鐘產(chǎn)生電路、合理設(shè)計adc的供電以及采用退耦電容等。本文主要討論采樣時鐘抖動對adc信噪比性能的影響以及低抖動采樣時鐘電路的設(shè)計。 (a)12位adc理想信噪比 (b)ad9245實測信噪比圖1 不同時鐘抖動情形下12位adc的信噪比示意圖時鐘抖動對adc 信噪比的影響采樣時鐘的抖動是一個短期的、非積累性變量，表示數(shù)字信號的實際定時位置與其理想位置的時間偏差。時鐘源產(chǎn)生的抖動會使adc的內(nèi)部電路錯誤地觸發(fā)采樣時間，結(jié)果造成模擬輸入信號在幅度上的誤采樣，從而惡化adc的信噪比。在時鐘抖動給定時，可以利用下面的公式計算出adc的最大信噪比：根據(jù)公式(2)，圖1分別給出了量化位數(shù)為12-bit時不同時鐘抖動情形下adc
ADI新推12BIT單片模數(shù)轉(zhuǎn)換器功耗降低40％
器件。此器件以65 msps轉(zhuǎn)換速率工作時功耗為190 mw，40 msps時功耗為135 mw，20 msps的時功耗為90 mw，從而允許用于便攜式12 bit多通道系統(tǒng)并且簡化了信號路徑。ad9237的擴縮功能可進一步節(jié)省功耗，當(dāng)降低轉(zhuǎn)換器速度時可以降低功耗。ad9237采用3 v單電源供電，并且提供獨立數(shù)字輸出驅(qū)動電源以便為2.5 v和3 v邏輯器件供電。引腳兼容性和差分采樣保持放大器 ad9237與adi公司的10 bit ad9215，12 bit ad9235和14 bit ad9245 20/40/65 msps adc，以及12 bit ad9236，14 bit ad9245 80 msps adc引腳兼容。這使得應(yīng)用工程師容易改變分辨率和速度，或者便于為下一代系統(tǒng)升級性能。此外，ad9237擁有專利權(quán)的采樣保持放大器（sha）輸入級允許用戶選擇各種輸入范圍和偏移，其中包括單端應(yīng)用。ad9237適用于在相繼通道中切換滿度電壓的多路復(fù)用系統(tǒng)以及以完全高于奈奎斯特（nyquist）速率對單通道輸入信號采樣應(yīng)用。還推薦ad9237與幾款adi公司業(yè)界領(lǐng)先的放大器產(chǎn)品（包括ad8

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