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一種高速跳頻接收機的改進(jìn)設(shè)計方案
器關(guān)鍵參數(shù)指標(biāo)如下：每個pll 的環(huán)路帶寬200 khz，鎖定時間小于50 μs，mcu 頻率預(yù)置時間小于2 μs；射頻開關(guān)完成雙環(huán)切換所需時間為幾十納秒[ 5]。鎖相環(huán)采用adf4360-3 ，射頻開關(guān)采用吸收式單刀雙擲開關(guān)hmc349ms8g，隔離度約60 db@1.8 ghz 。 3.4 下變頻器與自動增益控制直接下變頻器集成了可變增益放大器(vga) ，其變換增益具有69.5 db 的動態(tài)范圍，可與基帶輸出檢波器一起實現(xiàn)自動增益控制功能。下變頻器選用ad8347 ，其解調(diào)帶寬90 mhz ，i/q 幅度平衡度0.3 db，正交相位誤差典型值±1°[ 6]。對高速跳頻信號而言，agc 瞬態(tài)特性是一個非常關(guān)鍵的指標(biāo)，必須減小電路時間常數(shù)，以保證能夠及時跟蹤輸入信號幅度的變化。具體措施是減小vga 控制輸入端的濾波電容值。 3.5 基帶低通濾波和放大射頻前端跳頻同步后的i /q 基帶信號帶寬約為20 mhz ，基帶低通濾波器采用5 階lc 橢圓函數(shù)濾波器的形式，l 、c 的值要精心選取，以滿足i 、q 通道平衡和相位誤差的要
集成運放的非線性失真分析及電路應(yīng)用
ail to rail)反饋放大器方式，擴展了輸出電壓范圍，更加方便了ad8062的使用。相比于同類型電流反饋放大器，ad8062具有較寬的信號輸入帶寬和較高的壓擺率特性，適合應(yīng)用在擴頻通信電路中。 2．2 ad8062電路實現(xiàn)和應(yīng)用在下面的電路設(shè)計中，ad8062采用單電源3．3 v供電方式，輸入端使用的是i／q兩路正交信號，用于測試的輸入信號是單頻信號，輸入信號功率范圍為-28～-12 dbm，信道帶寬5 mhz。集成運放的電路設(shè)計應(yīng)用在ism頻段定位系統(tǒng)的接收射頻前端電路，在ad8347對i／q正交射頻信號下變頻后，對基帶信號進(jìn)行放大輸出。ad8062差分放大采用的是雙端輸入單端輸出的方式，i／q兩路雙極性信號經(jīng)集成運放合并后傳輸給a／d變換器進(jìn)行采樣。當(dāng)接收信號為跳頻信號時，ad8062電壓的變化速率很快，能夠即時跟隨階躍電壓的變化。最初的設(shè)計采用圖1(a)所示的電路連接方式，其中設(shè)計的mimo系統(tǒng)接收射頻前端曾有應(yīng)用，在mimo系統(tǒng)中采用的是單電源5 v供電方式，輸入信號頻率范圍為0～5 mhz，功率為-12 dbm。上述條件下，放大器的功率增益為11 db，信號輸出的諧波
FPGA配合預(yù)失真技術(shù)的解調(diào)誤碼測試儀
我們截取整個增補轉(zhuǎn)發(fā)系統(tǒng)中所需測試的相關(guān)電路，構(gòu)成待測系統(tǒng)可概括成如圖 1所示的結(jié)構(gòu)框圖。該待測系統(tǒng)由發(fā)射和接收兩部分組成，分別完成數(shù)據(jù)傳輸?shù)?qpsk調(diào)制發(fā)射及數(shù)字零中頻的 qpsk解調(diào)接收。各個模塊的芯片器件選取如下：fpga選用 xilinx公司的 spartan3系列的 xc3s2000； d/a，a/d轉(zhuǎn)換器分別選用 analog device（adi）公司的 ad9767和 ad9216；模擬正交上變頻和下變頻模塊分別選用 adi公司的 ad8349和 ad8347；vco則選用 adi公司的 ad4360，提供上、下變頻所需的 2.6ghz載波（注： ad4360為原系統(tǒng)發(fā)射板與接收板均采用的芯片，由于涉及到載波同步問題，實際的測試過程所需具體的方案選擇將在第 4部分進(jìn)行詳細(xì)討論和介紹）。由于是零中頻方案，qpsk調(diào)制僅需在 fpga中將 00，01，10，11四種狀態(tài)映射為 14位二進(jìn)制數(shù)以進(jìn)入 ad9767作模擬轉(zhuǎn)換，變換后的模擬信號在上變頻器件中與載波實現(xiàn)復(fù)乘作為射頻調(diào)制信號發(fā)射出去。接收機則是作與此相反的解調(diào)過程從而得到解調(diào)數(shù)據(jù)，

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