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Quad 350 MHz 24 V Amplifier
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Quad 350 MHz 24 V Amplifier
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IC-SM-QUAD +24V LCD DRV
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Current Feedback Amplifier 4 Circuit...
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Quad 350 MHz 24 V Amplifier
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72 pf，取c1=0.22μf，才能保證電容c1上的電壓變化不大于1/4 096(相當于12位adc的最低有效位的電壓值)。 第三、要滿足奈奎斯特定理的要求和充分利用adc的轉(zhuǎn)換速度?？够殳B濾波器的最大截止頻率為420/2=210 khz?？紤]抗混疊濾波器難以做到理想特性和按照工程上的習(xí)慣，假定抗混疊濾波器做到100 khz(即對100 khz以下的信號進行采樣)，由f=l/2πrc可計算得到r=7.2 ω。電阻尺的減小，電容c1的增大,對前級放大器的驅(qū)動能力和穩(wěn)定性提出了很高的要求。例如，ad8024是美國模擬公司生產(chǎn)的一款四元組350 mhz、24 v放大器，可驅(qū)動高容性負載，僅最大只能驅(qū)動1 000 pf的容性負載[18],遠遠不能滿足本例的要求。因此，在高速信號采集時就對抗混疊濾波器以及前級放大器(或稱為adc的驅(qū)動放大器)提出了很高要求。 第四、反過來，在對低頻信號進行采樣時，因電容c1的電容值保持不變和抗混疊濾波器截止頻率的要求，就要增加電阻r的阻值。但增加電阻r的阻值會提高直流通路的電阻分壓，從而造成直流誤差。例如，aduc84.1對信號源的內(nèi)阻要求低于61 q(可以保證其直流
=1lsb，即a>212，c1>4096c2。在實際應(yīng)用時，由于采樣頻率往往高于信號中的最高頻率數(shù)倍(>2)以上和高頻信號頻率往往幅值較低，對電容c1的要求c1>212c2可以適當?shù)姆艑?。為保證測量的可信度，后面都同上考察最差情況，實際應(yīng)用中可適當放寬要求。 在aduc841中的電容c2的值為32pf，c1≥4096c2=131072pf，取標稱值c1=0.22mf。 現(xiàn)有的運算放大器對容性負載的驅(qū)動能力有限，當r較小c1值較大時，運放驅(qū)動大容性負載時可能會產(chǎn)生振蕩。ad8024是一種四元組350mhz、24v的放大器，據(jù)其數(shù)據(jù)手冊稱可驅(qū)動高電容性負載，其最大也可以驅(qū)動1000pf的容性負載?？梢?，運放驅(qū)動能力限制了無源抗混疊濾波器的應(yīng)用，尤其在高精度數(shù)據(jù)采集系統(tǒng)中。這在實際應(yīng)用中應(yīng)該引起注意。 有源抗混疊濾波器的驅(qū)動 圖2為有源抗混疊濾波器中的運放驅(qū)動adc的簡單示意圖。有源抗混疊濾波器中的運放作為驅(qū)動放大器，必須提供足夠的輸出電流以驅(qū)動adc輸入；其帶寬應(yīng)該接近采樣頻率的兩倍；運放建立時間應(yīng)與adc采樣時間相匹配。下面就這幾個方面討論有源抗混疊濾波電路中的驅(qū)動放
失效的4路高速電流反饋放大器，－3dB帶寬350MHz在G＝＋1時，轉(zhuǎn)換率2400V/μs，VS＝±12V；驅(qū)動高電容負載，35ns建立時間(0.1％)；300pF負載，6V階躍，在18ns內(nèi)穩(wěn)定時間為0.1％；5pF負載，2V階躍；低功率：在＋5～±12V(24V)范圍操作，4mA/放大器電源電流；極好的視頻規(guī)格(RL＝150Ω，G＝＋2)：增益平直度0.1dB(在70MHz時)，0.04％差分增益，0.09°差分相位；串擾－58dB在5MHz時；THD－72dBc在5MHz時；DC精度：VOFFSET為2mV(典型值)，IBIAS：3μA(最大值)；16引腳的NSOIC封裝
各位高手：誰用過ad8024情進，我需要你們的幫助?。?我選用了ad8024作為放大器件，可是按著pdf文件中的接法電路連接后，放大器不工作，給放大器一個信號，沒有輸出信號，而放大器的電源和地都連接良好，我把dgnd和vss連接在一起，并和dis連接在一起，認為這樣可以讓放大器處于工作狀態(tài)，可是放大器就是不工作，請問各位高手：這是怎么回事？
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