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基于AD7892SQ和CPLD的數(shù)據(jù)采集系統(tǒng)
0 引言本系統(tǒng)以ad7892sq和cpld(復(fù)雜可編程邏輯器件)為核心設(shè)計(jì)了一個(gè)多路信號(hào)采集電路，包括模擬多路復(fù)用、集成放大、a/d轉(zhuǎn)換，cpld控制等。采用硬件描述語(yǔ)言verilog hdl編程，通過(guò)采用cpld使數(shù)據(jù)采集的實(shí)時(shí)性得到提高。 1 硬件設(shè)計(jì) 針對(duì)多路信號(hào)的采集，本系統(tǒng)采用4/8通道adg508a模擬多路復(fù)用器對(duì)檢測(cè)的信號(hào)進(jìn)行選擇，cmos高速放大器lf156對(duì)選中的信號(hào)進(jìn)行放大，ad7892sq實(shí)現(xiàn)信號(hào)的a/d轉(zhuǎn)換，cpld完成控制功能。電路如圖1所示。 ad7892sq是美國(guó)ad公司生產(chǎn)的lc2mos型單電源12位a/d轉(zhuǎn)換器，可并行或串行輸出。 ad7892sq a/d轉(zhuǎn)換器具有如下特點(diǎn)：?jiǎn)坞娫垂ぷ?+5 v或+10 v)；內(nèi)部含有采樣保持放大器；具有高速的串行和并行接口。 ad7892sq控制字的功能如下： a)mode：輸入控制字，低電平時(shí)為串行輸出，高電平時(shí)為并行輸出，本系統(tǒng)為并行輸出； b)standby：輸入控制字，低電平時(shí)為睡眠狀態(tài)(功耗5 mw)，高電平時(shí)正常工作，一般應(yīng)用時(shí)接高電平； c)convst：?jiǎn)?dòng)轉(zhuǎn)

基于AD7892SQ和CPLD的數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
1 引言原文位置
　　近年來(lái)，射頻電路在數(shù)字電視中得到廣泛應(yīng)用，作為數(shù)字電視發(fā)射機(jī)中十分重要的大功率功放模塊，如何做到功率、增益與線性度的最優(yōu)化是當(dāng)前的重要課題。由于功放管特性曲線的非線性，在大信號(hào)情況下工作的功放會(huì)產(chǎn)生非線性...
基于AD7892SQ和CPLD的數(shù)據(jù)采集系統(tǒng)

0 引言

　　本系統(tǒng)以AD7892SQ和CPLD(復(fù)雜可編程邏輯器件)為核心設(shè)計(jì)了一個(gè)多路信號(hào)采集電路，包括模擬多路復(fù)用、集成放大、A/D轉(zhuǎn)換，CPLD控制等。采用硬件描述語(yǔ)言Verilog HDL編程，通過(guò)采用CPLD使數(shù)...

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