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  • 基于FPGA的雙備份多路數(shù)據(jù)采集存儲(chǔ)系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

    /d采集控制、編幀、內(nèi)部時(shí)序控制等功能,包括長(zhǎng)線接口電路、控制電路、存儲(chǔ)器接口電路、幀結(jié)構(gòu)下載電路等。 采編器的主控器件采用xc2s100e型現(xiàn)場(chǎng)可編程門陣列(fpga),該器件體積小、功耗低、內(nèi)部延時(shí)小,全部控制邏輯由硬件自動(dòng)完成,編程配置靈活,可實(shí)現(xiàn)程序的并行執(zhí)行,因而可大大提高系統(tǒng)的工作性能。該采編器的電壓采集范圍為0~+5 v,采集精度不低于0.1%.由于fpga本身不具備a/d轉(zhuǎn)換模塊,因此各通道的模擬信號(hào)分別經(jīng)信號(hào)調(diào)理電路后,由模擬多路開關(guān)adg506選擇模擬通道,再經(jīng)外部高速ad7667實(shí)現(xiàn)a/d轉(zhuǎn)換,轉(zhuǎn)換的數(shù)據(jù)在fpga內(nèi)編幀后輸出到存儲(chǔ)器中。具體的每幀數(shù)據(jù)由各路模擬信號(hào)和幀標(biāo)記fdb1 8540組成。采編器的電源由電源模塊提供的5 v電壓經(jīng)tps70351調(diào)理后產(chǎn)生。 采編器電路框圖如圖2所示。 2.2存儲(chǔ)器電路的設(shè)計(jì) 存儲(chǔ)器主要完成數(shù)據(jù)的存儲(chǔ)功能,存儲(chǔ)器包括兩套獨(dú)立的存儲(chǔ)電路a、b片,兩者互為備份。每套存儲(chǔ)器內(nèi)包括與采編器相連的長(zhǎng)線接口、fpga和flash存儲(chǔ)芯片。該雙備份設(shè)計(jì)能進(jìn)一步提高數(shù)據(jù)回收的可靠性。 存儲(chǔ)器電路框圖如圖3所示。

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