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74lvt574中文資料

  • 基于AD9481芯片的毫米波雷達(dá)信號(hào)采樣系統(tǒng)設(shè)計(jì)

    ，其dco時(shí)鐘是互相反相的，dco-時(shí)鐘對(duì)應(yīng)的數(shù)據(jù)輸出通道是a通道，dco+時(shí)鐘對(duì)應(yīng)的通道是b通道，對(duì)于采集時(shí)鐘信號(hào)來(lái)說(shuō)，b通道的數(shù)據(jù)要比a通道的數(shù)據(jù)晚一個(gè)周期，而對(duì)于輸出的dco時(shí)鐘來(lái)說(shuō)，b通道的數(shù)據(jù)要比a通道晚半個(gè)周期。由于數(shù)據(jù)是交叉式輸出的，其順序不會(huì)改變，因此，對(duì)于雙通道數(shù)字采樣的同步問(wèn)題，可以由后端不同通道的fifo緩存來(lái)實(shí)現(xiàn)數(shù)據(jù)的排序。 本系統(tǒng)中的兩個(gè)ad9481分4個(gè)通道輸出數(shù)據(jù)，為了配合cpld控制fifo來(lái)實(shí)現(xiàn)輸出數(shù)據(jù)的同步，輸出的8bit數(shù)據(jù)應(yīng)先經(jīng)過(guò)鎖存器 74lvt574，然后進(jìn)入各自通道的fifo來(lái)實(shí)現(xiàn)存儲(chǔ)，ad9481的輸出時(shí)鐘dco可經(jīng)過(guò)異或門74vcx86加到各自通道的fifo上，其連接結(jié)構(gòu)如圖3所示。 對(duì)于每一路采樣系統(tǒng)，將dco-和cpld輸出的鎖存有效信號(hào)相異或，便可得到輸出a通道鎖存74lvt574的輸入時(shí)鐘，而將dco+和cpld 輸出的鎖存有效信號(hào)相異或，就可以得到輸出b通道鎖存74lvt574的輸入時(shí)鐘，將dco-和cpld輸出的fifo有效信號(hào)相異或，即可得到輸出a通道fifo的寫入時(shí)鐘，dco+和cpld輸出的fifo

  • 基于AD9481的毫米波雷達(dá)信號(hào)采樣系統(tǒng)設(shè)計(jì)

    co時(shí)鐘是互相反相的，dco-時(shí)鐘對(duì)應(yīng)的數(shù)據(jù)輸出通道是a通道，dco+時(shí)鐘對(duì)應(yīng)的通道是b 通道，對(duì)于采集時(shí)鐘信號(hào)來(lái)說(shuō)，b通道的數(shù)據(jù)要比a通道的數(shù)據(jù)晚一個(gè)周期，而對(duì)于輸出的dco時(shí)鐘來(lái)說(shuō)，b通道的數(shù)據(jù)要比a通道晚半個(gè)周期。由于數(shù)據(jù)是交叉式輸出的，其順序不會(huì)改變，因此，對(duì)于雙通道數(shù)字采樣的同步問(wèn)題，可以由后端不同通道的fifo緩存來(lái)實(shí)現(xiàn)數(shù)據(jù)的排序。 本系統(tǒng)中的兩個(gè)ad9481分4個(gè)通道輸出數(shù)據(jù)，為了配合cpld控制fifo來(lái)實(shí)現(xiàn)輸出數(shù)據(jù)的同步，輸出的8bit數(shù)據(jù)應(yīng)先經(jīng)過(guò)鎖存器 74lvt574，然后進(jìn)入各自通道的fifo來(lái)實(shí)現(xiàn)存儲(chǔ)，ad9481的輸出時(shí)鐘dco可經(jīng)過(guò)異或門74vcx86加到各自通道的fifo上，其連接結(jié)構(gòu)如圖3所示。 對(duì)于每一路采樣系統(tǒng)，將dco-和cpld輸出的鎖存有效信號(hào)相異或，便可得到輸出a通道鎖存74lvt574的輸入時(shí)鐘，而將dco+和 cpld輸出的鎖存有效信號(hào)相異或，就可以得到輸出b通道鎖存74lvt574的輸入時(shí)鐘，將dco-和cpld輸出的fifo有效信號(hào)相異或，即可得到輸出a通道fifo的寫入時(shí)鐘，dco+和cpld輸出的fi

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74LVT32 74LVT245 74LVT244 74LVT16245 74LVT162245 74LVT126 74LVT125 74LVT04 74LVCU04 74LVCH162245

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