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當(dāng)前位置:維庫電子市場網(wǎng)>IC>74f574 更新時(shí)間:2025-08-29 20:06:03

74f574供應(yīng)商優(yōu)質(zhì)現(xiàn)貨

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歷史最低報(bào)價(jià):¥0.7500 歷史最高報(bào)價(jià):¥10.0000 歷史平均報(bào)價(jià):¥3.0583

74f574中文資料

  • CPLD在多路高速同步數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

    。 為突出重點(diǎn),epm7128s、ad676、lf398等器件的簡介此處不作介紹,僅列出ad676的控制時(shí)序,如圖2所示。圖2 多路模擬信號(hào)的同步采樣一般有兩種實(shí)現(xiàn)方法:一種為多個(gè)a/d轉(zhuǎn)換器同時(shí)進(jìn)行轉(zhuǎn)換;另一種為僅有一個(gè)a/d轉(zhuǎn)換器,各通道同時(shí)采樣,然后分時(shí)轉(zhuǎn)換。考慮到16位高速a/d轉(zhuǎn)換器ad676的價(jià)格因素,采用后一種方案。ad676有三個(gè)控制信號(hào):sample、ad-clk、cal。它們需要一定的時(shí)序配合才能正常工作,如圖2所示。由于ad676的轉(zhuǎn)換結(jié)果不具備三態(tài)輸出功能,所以需增加74f574和總線進(jìn)行隔離,為此配置控制信號(hào)wrad、rdad;同時(shí)要考慮到32路模擬信號(hào)的采樣保持控制s/h、多路切換器的控制信號(hào)m1a4~m1a0,以及輸入模擬信號(hào)選擇m0a1~m1a0、數(shù)據(jù)準(zhǔn)備好信號(hào)int1等共14個(gè)。cpld和處理器采用并行接口,因此其輸入信號(hào)有:系統(tǒng)復(fù)位信號(hào)rst、處理器的讀/寫信號(hào)rd/wr、片選信號(hào)iostrobe、外部時(shí)鐘輸入clk、輔助地址信號(hào)a20~a17和a5~a0、ad676的反饋輸入busy,共22個(gè)輸入。外加雙向數(shù)據(jù)總線d07~d00。設(shè)計(jì)中沒有將總線隔離器74

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