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更重要的是96mhz是該電路能測量的最高頻率。 確了穩(wěn)定性和fm調(diào)制兩個目的,振蕩器由一個變?nèi)荻O管控制頻率微調(diào)。變?nèi)荻O管的電容量由加在它上面的偏置電壓定。這個偏置電壓由兩個分量控制。12位 dac提供的直流電平和一個交流信號雙重作用在變?nèi)荻O管上以實現(xiàn)頻率調(diào)制。dac的輸出電壓初始值設(shè)置在中間值(2v),通過手動調(diào)整可變電容(微調(diào))把振蕩器調(diào)到指定的頻率,其後微控制器會稍微上下調(diào)整dac的輸出電壓來穩(wěn)定這個頻率。 要用微控制器測量振蕩器的頻率必須先把它進(jìn)行16預(yù)分頻。這可由普通的74f161 4位分頻器完成。預(yù)分頻輸出大概在5~6mhz頻率范圍,這個頻率可以用微控制器的16位計數(shù)器/定時器進(jìn)行計數(shù)。 確了確定振蕩頻率,先把16位計數(shù)器清零,經(jīng)過設(shè)定的時間間隔之後再把它的值讀出來。設(shè)定時間間隔由微控制器中另一個計數(shù)器/定時器編程控制,每5.461ms周期中斷一次。這樣16位計數(shù)器中的值可以這樣計算∶ counter/timer value=(fosc/16)×(5.461×10-3) 實際操作時微控制器讀出16位定時器的值把它與用你選擇的頻率代人上述方程計算出來的
被送到存儲器總線上的數(shù)據(jù)在接收與存儲控制器產(chǎn)生的寫脈沖/iwr作用下,存儲在相應(yīng)的存儲單元中。 數(shù)據(jù)接收與存儲控制器由cpld復(fù)雜可編程邏輯器件epm7128s的一部分(另一部分作控制接口設(shè)計)設(shè)計而成,通過編程實現(xiàn)如下電路功能: ·同步移位脈沖計數(shù)器; ·7路數(shù)據(jù)起始與終止位同步校驗; ·寫脈沖/iwr形成; ·存儲器地址a0~a15發(fā)生器; ·存儲地址計數(shù)脈沖atrr形成; ·同步信息檢測與同步控制。 接收器與發(fā)送器的數(shù)據(jù)同步由74f161計數(shù)器與cpld的內(nèi)部邏輯電路組成同步信息檢測器,對同步傳輸光路傳輸業(yè)的移位時鐘進(jìn)行檢測并實現(xiàn)同步控制。74f161計數(shù)器計數(shù)時鐘由osc2提供,頻率與發(fā)送時鐘頻率相一致,由32mhz有源晶振產(chǎn)生。計數(shù)器的清零輸入來自經(jīng)cpld內(nèi)部反相器反相的sclk,同步時序見圖5的接收與存儲時序部分。在數(shù)據(jù)移位期間,每來一個移位時鐘脈沖,計數(shù)器就清一次零。而在每個移位脈沖的周期內(nèi),計數(shù)器的計數(shù)時鐘輸入端有同數(shù)。從理論分析,它有兩種情況:第一種飛速是計數(shù)脈沖的上升沿在復(fù)位脈沖的低電平時出現(xiàn),計數(shù)器因處于復(fù)位狀
圖3所示。 1.2 任意波形產(chǎn)生電路的設(shè)計 如圖4所示,一個完整的任意波形產(chǎn)生電路主要由時鐘發(fā)生電路、地址計數(shù)器、波形存儲器、鎖存器、奇偶數(shù)據(jù)選擇電路以及d/a轉(zhuǎn)換器構(gòu)成。 時鐘發(fā)生電路用于產(chǎn)生任意波形發(fā)生器所需的可變時鐘,通??梢杂蓡纹瑱C(jī)控制的鎖相環(huán)電路構(gòu)成,在實際設(shè)計中采用鎖相環(huán)集成電路,產(chǎn)生最高頻率為100 mhz的時鐘信號,時鐘電路的輸出信號送往地址計數(shù)器的時鐘輸入端,以驅(qū)動地址計數(shù)器掃描波形存儲器中的數(shù)據(jù),地址計數(shù)器采用15位二進(jìn)制同步計數(shù)器,邏輯上等同于4片74f161級聯(lián),地址計數(shù)器輸出的15位地址數(shù)據(jù)與波形存儲器的地址輸入端相連,波形存儲器使用四片32 k×8(讀寫速度為12 ns)的sram級聯(lián)成32 k×32的sram陣列,sram陣列輸出端的32比特數(shù)據(jù)中,24比特為波形數(shù)據(jù),2比特為控制信號,其余6比特數(shù)據(jù)線不使用。每個波形點分辨率為12比特,每個地址存放兩個波形點的數(shù)據(jù),單片段任意波信號最長可達(dá)64 k個點,2個控制信號分別為停止位、同步位,停止位數(shù)據(jù)線通過d觸發(fā)器與地址計數(shù)器的預(yù)置數(shù)控制端端相連,當(dāng)檢測到掃描至最后一個波形地址時,停止位將地址計