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的鎖相環(huán)位同步提取電路 該電路如圖2所示，它由雙相高頻時鐘源、過零檢測電路、鑒相器、控制器和分頻器組成。 雙相高頻時鐘源 該電路由d觸發(fā)器組成的二分頻器和兩個與門組成，它將fpga的高頻時鐘信號clk_xm變換成兩路相位相反的時鐘信號，由e、f輸出，然后送給控制電路的常開門g3和常閉門g4。其中f路信號還作為控制器中的d1和d2，觸發(fā)器的時鐘信號。實際系統(tǒng)中，fpga的高頻時鐘頻率為32.768mhz，e、f兩路信號頻率為32.768／2=16.384mhz。 過零檢測電路 該電路見圖2中g(shù)ljc部分，它由d觸發(fā)器和異或門組成。過零檢測的輸出脈沖codeout的寬度應(yīng)略大于f路信號一個周期，但為了減少鎖相環(huán)的穩(wěn)態(tài)誤差，該輸出脈沖不宜過寬。實際系統(tǒng)中，過零檢測電路的時鐘信號clkin由fpga的高頻時鐘四分頻得來，這樣輸出的脈沖寬度約是f路信號的兩個周期。 鑒相器 該電路由兩個與門組成，分別是超前門g1和滯
2，則停止計數(shù)，并將計數(shù)值phase輸出。計數(shù)值phase反映了輸入/輸出信號的相位差，具體關(guān)系見(1)式。數(shù)字鑒頻器設(shè)計的基本思想與邊沿觸發(fā)鑒相器類似。當(dāng)檢測到high_pulse_1，從0開始增計數(shù)，直到檢測到下一個high_pulse_1，將計數(shù)值feq輸出，計數(shù)器從0開始繼續(xù)計數(shù)。計數(shù)值feq與輸入信號頻率之間的關(guān)系見(2)式。限于篇幅，鎖相環(huán)的vhdl設(shè)計程序這里不再贅述。 仿真與硬件測試結(jié)果本設(shè)計使用altera公司的quartus ii 3.0進行設(shè)計和仿真。系統(tǒng)時鐘clk頻率為32.768mhz，輸入信號s_in的頻率為1mkhz，cs為片選信號(高電平有效)，輸出信號為s_out，phase為鑒相器輸出的與相位差相對應(yīng)的計數(shù)值，cycle為鑒頻器輸出的與輸入信號的頻率相對應(yīng)的計數(shù)值。仿真波形顯示輸出信號能快速實現(xiàn)對輸入信號相位的鎖定。在波形仿真結(jié)束后，又對系統(tǒng)在硬件測試平臺上進行了測試。測試平臺采用altera公司的fpga芯片-ep1k50qc208-3。測試表明鎖相環(huán)能很好地對頻率和相位均發(fā)生快速改變的信號進行鎖定。 結(jié)語采用fpga技術(shù)實現(xiàn)的基于邊沿觸發(fā)鑒相的數(shù)字鎖相環(huán)，不僅
、4路音頻信號。二次復(fù)用的思想類似于脈沖編碼調(diào)制。在發(fā)送端，多路模擬視頻/音頻信號經(jīng)adc轉(zhuǎn)換為多路數(shù)字視頻/音頻信號，為了減輕復(fù)接單元的壓力，首先將多路數(shù)字信號分別通過一個合路器進行一次復(fù)用，復(fù)用為1路或幾路較高速并行數(shù)字信號，然后再將其送到復(fù)接單元g—link進行二次復(fù)接，得到高速串行數(shù)字信號；在接收端，高速串行信號首先經(jīng)過分接單元進行一次解復(fù)用，得到較高速多路并行數(shù)字信號，然后分別經(jīng)分路器進行二次解復(fù)接恢復(fù)為多路數(shù)字視頻/音頻信號，再通過dac轉(zhuǎn)換為多路模擬信號。整個系統(tǒng)的同步主時鐘由一個32.768mhz的晶振提供。二次復(fù)/解復(fù)接由hdmp1032/1034串行/解串行芯片來完成，所以主要設(shè)計的是信號的一次復(fù)/解復(fù)接部分。由于4路音頻信號最后合為1路串行信號進入hdmp1032/1034芯片組，所以4路音頻復(fù)/解復(fù)接的時序是整個系統(tǒng)的關(guān)鍵。 視頻信號的處理首先，分別對視頻和音頻信號進行量化復(fù)接。兩路視頻經(jīng)過a/d轉(zhuǎn)換后，采用12位量化后輸出24路數(shù)字信號，取樣速率為16.384mhz，然后經(jīng)過2：1的復(fù)接器。復(fù)接的具體做法是第一路a/d轉(zhuǎn)換量化后的第一位a0與第二路a/d轉(zhuǎn)換量化后的第一位b0
芯片由數(shù)字鎖相環(huán)、時隙產(chǎn)生電路、時隙插入電路、時隙提取電路和cpu接口控制電路組成，實現(xiàn)n*64k端口信號上行到e1線或從e1線提取n*64k端口信號的功能。 zi9001芯片內(nèi)部有數(shù)字控制振蕩器(dco)，不需要外接壓控振蕩器，支持兩個n*64k數(shù)據(jù)端口(n值可設(shè)置為0~32，若兩個n*64k數(shù)據(jù)端口同時使用，兩個n值之和不能大于32)。e1時隙可靈活配置；支持多芯片級聯(lián)，支持多于2個數(shù)據(jù)端口；微處理器的接口地址、數(shù)據(jù)總線可多路復(fù)用，也可不復(fù)用；支持芯片自檢測試、環(huán)回測試；需要外接1個32.768mhz的振蕩器；e1端口及n*64k端口的數(shù)據(jù)輸入采樣時鐘沿和數(shù)據(jù)輸出時鐘沿可靈活設(shè)置n*64k端口工作模式可設(shè)置為dte模式或dce模式；輸入輸出的幀同步信號可延遲設(shè)置采用+5v電源(精度±10%)供電。zi9001芯片采用0.6um cmos工藝制造，qfp100封裝。 來源:小草
首先，amc1210中的正弦濾波器對調(diào)制器的位流進行濾波，以將其轉(zhuǎn)換為中等分辨率、中等速率的數(shù)據(jù)字。對ads1205而言，最高效的三階正弦濾波器的過采樣率(osr)為128。過采樣率超過128時，osr每增加一倍，信噪比僅增加3db。在解調(diào)過程后利用積分器可以達(dá)到同樣的效果，而且還能縮短濾波器的延遲時間。 將osr設(shè)為128時會產(chǎn)生一個14位的數(shù)字調(diào)制信號，其數(shù)據(jù)速率為： 該等式中，fmod表示調(diào)制器的時鐘頻率，該時鐘頻率在調(diào)制器中降為原來的一半。在下例中，當(dāng)時鐘信號頻率為32.768mhz時，三階正弦濾波器的數(shù)據(jù)速率為128khz。 現(xiàn)在需要對信號進行解調(diào)(如圖3所示)。 圖3：amc1210內(nèi)部的解調(diào)過程示例 這表示當(dāng)未調(diào)制載波為正時，14位數(shù)字信號須乘以+1，若未調(diào)制載波為負(fù)則須乘以-1。我們需要考慮到載波信號通過旋轉(zhuǎn)變壓器、線圈、調(diào)制器以及正弦濾波器時產(chǎn)生的延時。因此，amc1210具有相移校驗功能，能夠在相移90度內(nèi)正常工作。若相移超過此范圍，則必須在寄存器中編程。 最后，積分器osr的設(shè)定原則是：載波頻率是整個濾波器傳輸函數(shù)陷波的整數(shù)倍。在時
);ic3選用cd4013雙d觸發(fā)器集成電路;lc4和1c7-icl5均選用twh8778大功率電子開關(guān)集成電路;ic5選用ne555或lm555時基集成電路;ic6選用cd4017或cc4017十進制計數(shù)/分配器集成電路。 t選用8-iow、二次電壓為9v的電源變壓器。 s0選用觸頭電流容量大于10a的電源開關(guān);s5選用常開型按鈕。 kl-k9選用jzc-2lf或jzc-6f、jzc-7f型超小型中功率直流繼電器。 yvl-yv9均選用交流220v電磁水閥。 bcl和bc2均選用32.768mhz的石英晶振。
d4013雙d觸發(fā)器集成電路；ic4和ic7～ic15均選用twh8778大功率電子開關(guān)集成電路；ic5選用ne555或lm555時基集成電路；ic6選用cd4017或cc4017十進制計數(shù)/分配器集成電路。 t選用8～low、二次電壓為9v的電源變壓器。 s0選用觸頭電流容量大于10a的電源開關(guān)；ss選用常開型按鈕。 k1～k9選用jzc-21f或jzc-6f、jzc-7f型超小型中功率直流繼電器。 yv1～yv9均選用交流220v電磁水閥。 bc1和bc2均選用32.768mhz的石英晶振。 歡迎轉(zhuǎn)載，信息來源維庫電子市場網(wǎng)（www.udpf.com.cn）
32.768mhz 晶體問題小弟 采用的是非對稱振蕩電路（清華－數(shù)字電子技術(shù)基礎(chǔ)3－353頁），74f04 的1、2兩腳間接510電阻，1、4接晶體兩端，2和3，4和5短接，測試第6腳。
32.768mhz正弦 鑒相（附圖）光信號強弱變化，影響結(jié)果（強度應(yīng)與相位無關(guān)）信號是正弦，120m示波器觀察，波形基本可以，不知怎么定性。ad8561過零比較后并不是方波（梯形，有振鈴）。鑒相器是ad8302。光信號變化時，發(fā)現(xiàn)比較后的“方波”后沿有抖動（相位變化）。 * - 本貼最后修改時間：2005-8-16 13:57:50 修改者：wypheaven
用定時器時的問題出現(xiàn)在哪兒？我用的芯片是atmega128，想采集速度要做個精確定時。用t0使用外部晶振32.768mhz，定義的assr＝0x40吧，忘記了，總之是開了異步時鐘，然后開了定時器的中斷timsk=0x01;總中斷使能也開sei();可就是不定時也不產(chǎn)生中斷，有人可以告訴我原因嗎？以前使用定時器時采用內(nèi)部晶振，做中斷的時候可以做到，可是最近怎么出也實現(xiàn)不了。請教一下各位，比如說定時器0，實現(xiàn)中斷不就是開全局中斷sreg、timsk，還有定義tccr0，再就是賦tcnt0值嗎？可是我就是實現(xiàn)不了。以前編譯好的文件可以實現(xiàn)定時，但是一旦復(fù)制到新建的工程中就實現(xiàn)不了了。實在找不出理由，只有求救各位了。謝謝?。?！
個人建議根據(jù)你外圍電路的使用情況來決定，用tc0吧，使用32.768mhz的晶振，實現(xiàn)一秒定時非常容易，這是常用的方法，也可以用16位定時器，定一秒，然后累加就可以了
加大電容嗎？對于隔直，不就是電容的充放電嗎？我以為rc約大就像是微分，rc小波形失真就小。不知和直流有什么關(guān)系？我應(yīng)該怎么算呢？我后面是lc選頻，和過零比較。要看他們阻抗，1/(2×pi×rc)要小于振蕩頻率32.768mhz？ 我直接加大電容，我現(xiàn)用的是0.01u要提高多少好呢，對波形會有影響嗎。
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