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...DAC,電流輸出,8位數(shù)字輸入,輸出建立時(shí)間0.2μs/0.15μs,其數(shù)字輸入端可采用5 V/15 V兩種輸入,本電路采用兼容TTL電平的5 V輸入。電路中將其輸入控制端CS、WR同時(shí)接地,當(dāng)有來自FPGA的數(shù)據(jù)AD101~7輸入時(shí)無需鎖存,直接進(jìn)行轉(zhuǎn)換,因此要求FPGA的輸出要具有鎖存功能,此接法可減少輸出控制線,減少時(shí)序干擾。R1AD1和R1AD2為D/A輸出波形調(diào)整電阻,主要用于調(diào)整波形位置,不致產(chǎn)生失真...
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