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用Verilog怎么實(shí)現(xiàn)RS觸發(fā)器的功能？ |
| 作者：errisa 欄目：EDA技術(shù) |
用硬件電路很好做，一個(gè)74F74就可以搞定，但用Verilog如何寫出RS觸發(fā)器呢？ input OUTPUT 端口 R S Q 狀態(tài) H L H 狀態(tài) L H L 狀態(tài) L L H 作出正確地話應(yīng)該是個(gè)階躍信號(hào)，但我做出來(lái)的Q總是一個(gè)脈沖波形 為什么？ |
| 2樓： | >>參與討論 |
| 作者： 雷風(fēng) 于 2006/1/7 13:47:00 發(fā)布：
直接用語(yǔ)言描述阿 有什么問(wèn)題？ |
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| 3樓： | >>參與討論 |
| 作者： xilinxer 于 2006/2/8 9:39:00 發(fā)布：
結(jié)構(gòu)表示也可以��！ 呵呵！這有啥？直接用門結(jié)構(gòu)描述！ |
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| 4樓： | >>參與討論 |
| 作者： caiquelin 于 2006/2/10 14:45:00 發(fā)布：
不能用門級(jí)描述的 用門級(jí)描述會(huì)有組合邏輯反饋的，搞得不好仿真程序就死掉了。而且不可綜合。DC和ＰＴ沒(méi)法ｃｈｅｃｋ你的ｔｉｍｉｎｇ的。建議直接調(diào)庫(kù) |
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