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請(qǐng)教：關(guān)于異步FIFO實(shí)現(xiàn)不同速率數(shù)據(jù)傳輸?shù)膯?wèn)題 |
| 作者：littlebird 欄目：技術(shù)交流 |
敬請(qǐng)各位高人指點(diǎn): 使用FPGA實(shí)現(xiàn)的FIFO，兩邊時(shí)鐘異步，為了保證兩邊數(shù)據(jù)能正確傳輸而使用的FIFO，測(cè)試時(shí)把FIFO輸出數(shù)據(jù)環(huán)回用誤碼儀測(cè)試時(shí)，發(fā)現(xiàn)誤碼嚴(yán)重，是用lpm_fifo實(shí)現(xiàn)的，該如何解決呢？ 還有一個(gè)問(wèn)題是，為什么lpm_ram不支持1bit數(shù)據(jù)呢？我只好合成2bit數(shù)據(jù)送入FIFO，然后再取1bit,不知這個(gè)是不是有影響？ 多謝！ |
| 2樓： | >>參與討論 |
| 作者： woymoon 于 2005/5/22 16:57:00 發(fā)布：
這個(gè)問(wèn)題我也遇見過(guò) 我是用IDT的FIFO實(shí)現(xiàn)上下位機(jī)的通信，就是出現(xiàn)了這個(gè)問(wèn)題，由于項(xiàng)目重心偏移，問(wèn)題現(xiàn)在還擱置 |
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